【Verilog基础】逻辑综合(2)标准工艺库描述信息

本文介绍了Verilog逻辑综合中涉及的工艺库,包括目标库、链接库和符号库。目标库包含单元的行为、引脚、面积、时序信息,用于电路映射。链接库用于设置模块引用,尤其是IP核。符号库则关联到Designware库,包含加法器、乘法器等IP。在综合时,DC软件会根据这些库提供时序模型和单元选择。

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常用的几种工艺库介绍

1、 DC 需要工艺库文件: 目标库、 链接库、 符号库、 算术运算库。 注意四者区别。

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目标库

目标库是综合后电路网表要最终映射到的库, 目标库是由 Foundary 提供的,一般是.db的格式。这种格式是 DC 认识的一种内部文件格式,不能由文本方式打开。 .db 格式可以由文本格式的.lib 转化过来, 它们包含的信息是一致的。 目标库中包含了各个门级单元的行为、引脚、面积以及时序信息(有的工艺库还有功耗方面的参数), DC 在综合时就是根据目标库中给出的单元电路的延迟信息来计算路径的延迟。并根据各个单元延时、面积和驱动能力的不同选择合适的单元来优化电路。

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