本文介绍了数字IC验证中的虚拟序列（Virtual Sequences）和虚拟序列器（Virtual Sequencer）的使用，包括如何控制不同agent中sequence的执行顺序、同步机制如uvm_event和uvm_barrier的应用，以及序列库（Sequence Library）的建立和管理，强调了通过虚拟序列和序列库来协调多接口激励的时序和顺序。
导读：作者有幸在中国电子信息领域的排头兵院校“电子科技大学”攻读研究生期间，接触到前沿的数字IC验证知识，旁听到诸如华为海思、清华紫光、联发科技等业界顶尖集成电路相关企业面授课程，对数字IC验证有了一些知识积累和学习心得。为帮助想入门前端IC验证的朋友，思忱一二后，特开此专栏，以期花最短的时间，走最少的弯路，学最多的IC验证技术知识。
文章目录
- 一、学习内容
- 二、Virtual sequence & sequencer
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- 2.1、Virtual Sequences
- 2.2、Virtual Sequence/Sequencer
- 2.3、虚序列器 Virtual Sequencer
- 2.4、虚序列Virtual Sequence
- 2.5、将sequencer 连接到virtual sequencer（1/2）
- 2.6、将sequencer 连接到virtual sequencer（2/2）
- 2.7、Sequence 执行管理
- 2.8、同步机制：uvm_event
- 2.9、同步机制：uvm_barrier
- 2.10、同步使用特定资源池
- 2.11、uvm_event_pool 触发trigger
- 2.12、uvm_event_pool 等待触发 wait for trigger
- 2.13、保护激励（独占Grab/释放Ungrab）
- 2.14、资源池：uvm_pool
- 2.15、小结
- 三、Sequence Library
一、学习内容
- 在特定的phase中，使用Virtual Sequence 和 Virtual Sequencer 控制Sequence的执行顺序
- 不同agent中的sequence执行顺序控制
- 在virtual Sequence中管理Sequence执行的同步
- uvm_event
- uvm_barrier
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