【AD错误】Un-Routed Net Constraint: Unplated Pad S1-1(2.54mm,20.322mm) on Multi-Layer...解决办法

最新推荐文章于 2025-10-13 21:00:00 发布
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本文讨论了在使用三端纽子开关封装时遇到的问题，即未电镀导致的顶层与底层不连通。文章详细解释了unplated的含义，并提供了解决方案：勾选对应的plated选项。

问题及原因分析

问题出现在了一个三端纽子开关的封装，因为是从别处copy的，没想到出现了此等问题。

在这里插入图片描述

在这里插入图片描述

unplated 意思是没有电镀的，如果没有电镀那么顶层和底层之间是没有沉铜的，就是不连的。

解决办法

勾选对应的plated。

在这里插入图片描述

Altium Designer DRC规则报错
weixin_42066633的博客
08-26 1万+
DRC全称design rule check 设计规则检查 Un-Routed Net ConStraint报错的原因 找一下是否有开路这个error致命 Silk To Solder Mask Clearance Constraint报错的原因 这是因为丝印层到阻焊层的间距不满足规则这个error不致命 Un-Routed Net ConStraint报错的原因 指元器件间的安全距离，设计规则需要修改这个error不致命 但最好修改下...
原理图与 PCB 绘制备忘
朱工的专栏
11-17 3597
原理图与 PCB 绘制备忘。
【Altium Designer 报错集】1.Warnings：Zero hole size multi-layer pad(s) detected
王哪跑的博客
10-13 466
【内容摘要】Altium Designer 报错 AD报错 Warnings：Zero hole size multi-layer pad(s) detected 解决Zero hole size multi-layer pad(s) detected 报警错误
AD使用笔记
sqeasww的博客
01-16 4083
去除自己不想要的铺铜区域 1.点击place–>polygon pour cutout。 2.出现光标，然后把你想要去除的那个区域选中，如图一所示，单击右键退出选择模式。 3.双击没有被选中的区域，软件提示重新铺铜，选择确定，之后系统重新铺铜， 画螺丝孔 先选择图形，，，然后Tools ----convert-------create borad cutout from selected ...
Altium Designer 中的Un-Routed Net Constraint Violation错误
qq_41834874的博客
06-22 7963
设计PCB时常见的Un-Routed Net Constraint Violation一般是指同一个网络之间没有连线。但是如图所示的PCB中，虽然网络已经连接，但是仍然出现Un-Routed Net Constraint Violation错误。问题解决方法：焊盘的Plated的选项如图所示。
[Altium Designer] unplated multi-layer pad（s） detected 报错解决
06-18 1511
金属孔（镀铜）与非金属孔： 问题：在使用 mini_USB ，进行电气检查DRC时，遇到 “ unplated multi-layer pad（s） detected ” 的warning； 原因：mini_USB的PCB封装有两个安装孔（multi-pad），并且这两个multi-pad分别与管脚1（USB_IN）和5（GND）相连，而电气规则设置默认不允许无沉铜通孔； ...
Un-Routed Net Constraint: Unplated Pad 31-1(4176.633mil,3714.153mil) on Multi-Layer
03-14
嗯，用户遇到了PCB设计中的Un-Routed Net Constraint错误，特别是在多层板中涉及未镀层的焊盘。我需要根据提供的引用资料来整理解决方法。首先，用户的问题是关于未镀焊盘导致的未布线网络约束错误，所以需要明确未...
Un-Routed Net Constraint:Net VCCBAT Between Pad C1-1 on Top Layer And Pad 1-7 on Top Layer
最新发布
10-28
由于给定的引用内容未涉及关于‘Un-Routed Net Constraint:Net VCCBAT Between Pad C1 - 1 on Top Layer And Pad 1 - 7 on Top Layer’问题的解决方案，下面基于一般的PCB设计知识提供一些可能的解决办法： ...
Un-Routed Net Constraint ( (All) ) Un-Routed Net Constraint: Region (0 hole(s)) Bottom Layer Dead Copper - Net Not Assigned.
07-08
在PCB设计中，Altium Designer 报出 **Un-Routed Net Constraint Region Bottom Layer Dead Copper - Net Not Assigned** 错误通常涉及多个因素，包括未正确分配网络、敷铜区域设置不当或规则检查（DRC）触发的死铜...
Un-Routed Net Constraint ( (All) ) Un-Routed Net Constraint: Track (28.863mm,-12.62mm)(29.953mm,-12.62mm) on Top Layer Dead Copper - Net Not Assigned.
09-16
提供的参考引用中未包含关于'Un-Routed Net Constraint ( (All) )'错误提示以及'Track (28.863mm,-12.62mm)(29.953mm,-12.62mm) on Top Layer Dead Copper - Net Not Assigned'问题的解决方案相关内容，因此无法根据...
Class Document Source MClass Document Source Message Time Date No. [Un-Routed Net Constraint Violation] LM7805.PcbDoc Advanced PCB Un-Routed Net Constraint: Net NetC1_1 Between Pad R1-1(5080mil,4310mil) on Multi-Layer And Pad Q1-1(5240mil,3780mil) on Multi-Layer 18:18:16 2025/5/28 1essage Time Date No. [Un-Routed Net Constraint Violation] LM7805.PcbDoc Advanced PCB Un-Routed Net Constraint: Net NetC1_1 Between Pad R1-1(5080mil,4310mil) on Multi-Layer And Pad Q1-1(5240mil,3780mil) on Multi-Layer 18:18:16 2025/5/28 1
05-29
好的，用户遇到了Altium Designer中的Un-RoutedNet Constraint Violation错误，特别是在处理LM7805的PCB文件时。这个问题通常是由于未完全布线的网络引起的。首先，我需要根据用户提供的引用信息来分析可能的原因和...
【AD24报错】运行DRC后出现 Un-Routed Net Constraint ### Net Not Assigned 的解决方案
weixin_50499137的博客
09-21 1万+
AD24在运行PCB设计规则检查（DRC）后报错：Un-Routed Net Constraint: Split Plane (No Net) on Power Dead Copper - Net Not Assigned.
AD的“Un-Routerd Net Constraint:......”报错处理
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最近在画一个板子的时候，DRC检查出现一个报错：Un-Routerd Net Constraint:...... 当时就上百度找了一下，有说是焊盘属性里的“镀金”没有勾选，我核对了一下，发现我的焊盘没有问题；于是各种尝试，排除。  这是报错的具体位置：     最后，我把这个报错位置的电阻R9拖到外面去，然后再执行DRC，不难发现，还是有这个报错，因此可以
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csdn_song123的博客
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今天又学到了一招，在绘制PCB的时候，总是出现[Un-Routed Net Constraint Violation]，在PCB的设计文件中查找了三遍，才找到哦。特地写文，记录一下 过程是这样的，在设计一个文件的过程中，需要把文件的TOP的测试点，改成过孔的测试点，所以在自己建立封装的过程中，就是直接把mulite_layter层设计了一个孔，但是没有把空位的属性更改， 重点来啦，重点来啦，重点来啦，重要的事情说三遍。 这就是重点了，把这个勾选上，再次绘制PCB，然后DRC就不会又这个问题了。 ...
AD19 报错记录 Un-Routed Net Constraint: Net LED Between Pad J3-10
qq_31764341的博客
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AD报错： Un-Routed Net Constraint: Net LED Between Pad J3-10(1493.055mil,1510.079mil) on Multi-Layer [Unplate 当然我的线是连着的 就一直报错没有连接 而且是它自己和它自己没有 连接 然后网上查 说是封装顶底两层的焊盘没有电镀 就会出这个warning 可以选择不电镀 那么上下焊盘没有电连接 如果要电镀 那么找到这个封装 点这个焊盘-Properties-Hole information-Plated 把p
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baidu_41780339的博客
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Altium Designer 电气规则检查 报错：[Un-Routed Net Constraint Violation] 最近在学PCB制版，跟着B站教程画板子。到了最后一步电气规则检查，报错如下： 原因是布线未连接，但是画的板子很简单，可以确保网络之间是连了线的。如下图： 两个 MOSI 之间很明显是连接上的。但是出现报错，网上找了很多其他人的解决方法，包括寻找断线，焊盘镀金（plated）都不对。最后发现是自己在连线的时候直接用鼠标放置导线连接的，而不是采用CTRL+W 交叉布线连接的。当采用交
[Un-Routed Net Constraint Violation] 问题解决
m0_37479629的博客
01-30 1万+
今天遇到了一个特别沙雕的问题，Un-Routed Net Constraint Violation，并由此导致各种各样的错误。 百度好久没解决，只说是没接上网络，但是我已经连上了引脚，并且引脚已经上镀。 后来百实验，终于找到了问题所在，不能使用引线连接，要使用工具栏上的那个连线，带啥忘记了。 ...
Un-Routed Net ConStraint报错的原因
Mr.Liu
09-14 5万+
今天画PCB板，发现有一个报错显示Un-Routed Net ConStraint，怎么都解决不了，网上也找不到答案，最后把报错的线删除掉发现有一根飞线如下图所示：出错的原因就是他 最气人的是删除这根线下次编译还会报错，后来查看相同走线不报错的，发现原因是走直角 线时接头走了斜线引起的，下面是走线 左边不报错，右边报错 下面是删除垂直线后的走线 可以看出来左边正常，右边接头处出现小细线 原因：垂直走线要直连，不能在接头处走斜线，网上说是AD16版本的bug，之前用09版本都没出错过！ ...
【报错记录】Un-Routed Net Constraint
m0_65222834的博客
07-25 4410
错误记录
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