2FPGA_Verilog 语法基础之时序控制

最新推荐文章于 2025-09-23 16:35:41 发布
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本文介绍了时序控制的基本概念，包括触发条件及其在实际应用中的实现方式。以按键控制LED为例，阐述了如何利用时钟信号的上升沿作为触发条件来实现两个按键相与控制一个LED的状态切换。

时序控制：
首先要有触发条件，触发条件只要有电平变化就会触发，通常情况下以时钟作为触发条件；一个时钟周期内有两次电平变化，通常以时钟的上升沿作为触发条件posedge sclk
如图为两个按键相与控制一个led的量灭，即两个按键全为高电平时led灯为高；按键至少有一个为低电平时，led为低电平，led跳变为时钟的上升沿触发。

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