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原创 ICC2 报错:Design has unresolved cell references..(ROPT-007)

一个icc2的报错

2025-03-28 11:30:19 235

原创 STA 静态时序分析 第十章——鲁棒性分析(3)

这章节介绍了一些特别的STA分析:时间借用(time borrowing),时钟门控(clock gating),非时序检查(non-sequential timing checks)。此外,先进的STA概念如片上变化(on chip variation),统计时序(statistical timing),时序和功耗之间的折中平衡(trade off between timing and power)。

2024-12-13 11:37:24 995

原创 STA 静态时序分析 第十章——鲁棒性分析(2)

这章节介绍了一些特别的STA分析:时间借用(time borrowing),时钟门控(clock gating),非时序检查(non-sequential timing checks)。此外,先进的STA概念如片上变化(on chip variation),统计时序(statistical timing),时序和功耗之间的折中平衡(trade off between timing and power)。

2024-12-11 15:04:43 1141

原创 STA 静态时序分析 第十章——鲁棒性分析(1)

这章节介绍了一些特别的STA分析:时间借用(time borrowing),时钟门控(clock gating),非时序检查(non-sequential timing checks)。此外,先进的STA概念如片上变化(on chip variation),统计时序(statistical timing),时序和功耗之间的折中平衡(trade off between timing and power)。

2024-12-11 13:39:13 1054

原创 STA 静态时序分析 第九章——接口分析

这章节描述了对于多样的输入、输出路径的时序分析流程,以及几个常用的接口。特殊端口的时序分析,如SRAM;以及对于源同步接口的时序分析,也有讲到,如DDR SDRAM。

2024-11-28 20:28:50 876

原创 STA 静态时序分析 第八章——时序检查(3)

这个小节是前几小节的补充,主要介绍了一些例子,以及多时钟的情况。

2024-11-28 20:20:11 881

原创 STA 静态时序分析 第八章——时序检查(2)

这几小节主要讲了多周期路径、伪路径、半周期路径的问题。以及撤销时间检查、恢复时间检查的时序报告。最后讲了跨时钟域的时序问题。

2024-11-28 19:56:49 906

原创 STA 静态时序分析 第八章——时序检查(1)

本章描述了静态时序分析中执行的检查。这些检查旨在彻底验证待分析设计的时序。两个主要的检查为建立时间检查和保持时间检查。一旦触发器时钟引脚的时钟确定了,就会自动对触发器进行这两项检查。时序检查通常会在多种情况下进行,包括最坏-慢情况以及最好-快情况。通常来说,慢情况对于建立时间检查更严苛,快情况对于保持时间检查更严苛。这章节的例子,都假设了网络延时是0。这是为了简便起见,不会对之前解释的核心原理有影响。

2024-11-21 16:41:00 2334

原创 STA 静态时序分析 第七章——STA环境的配置(2)

这章节描述了如何配置静态时序分析的环境。正确的约束对于分析STA的结果十分重要。只有准确的指定设计的环境,静态时序分析才能识别出设计中所有的时序问题。准备工作包括:配置时钟、指定IO时序特征、指定伪路径以及多周期路径。下面详细介绍本章节。

2024-11-21 16:39:09 829

原创 STA 静态时序分析 第七章——STA环境的配置(1)

这章节描述了如何配置静态时序分析的环境。正确的约束对于分析STA的结果十分重要。只有准确的指定设计的环境,静态时序分析才能识别出设计中所有的时序问题。准备工作包括:配置时钟、指定IO时序特征、指定伪路径以及多周期路径。

2024-11-14 16:49:48 887

原创 STA 静态时序分析 第六章——串扰及噪声

这章节描述了纳米工艺中ASIC的信号完整性问题,在深亚细微米科技中串扰在设计的信号完整性方面,有着重要的影响。串扰噪音指的是信号之间无意的活动之间的耦合。相关的噪声、串扰分析方法如毛刺分析以及串扰分析,使得他们的影响能在静态时序分析中被体现。这些方法可以用来增加鲁棒性(robust)。

2024-11-13 21:53:50 1213

原创 STA 静态时序分析 第五章——延时的计算

这章节主要介绍了单元设计在预布局阶段(pre-layout)的延时计算以及在完成布局之后(post-layout)的时序验证。之前的几章节都关注于互联的建模以及单元库。我们将会利用单元以及互连建模的有关技术去获得设计的时序。

2024-10-25 12:14:28 1357 1

原创 STA 静态时序分析 第四章——互连寄生

这个章节中主要对寄生参数(寄生电阻、寄生电容)的有关内容进行了介绍。

2024-10-19 16:12:13 881

原创 STA 静态时序分析 第三章——标准单元库(3)

第三章的之前部分见链接文章。

2024-10-16 17:24:15 1028

原创 STA 静态时序分析 第三章——标准单元库(2)

这章节主要讲述了单元库描述的时序信息,单元应为标准单元。除了标准的时序信息,单元库描述还有单元面积、功能,这些虽然与时序没有直接的关系,但是会在RTL综合时发挥重要作用。这章节中,我们只关注与时序和功耗计算有关的信息。

2024-09-24 21:10:15 1224

原创 STA 静态时序分析 第三章——标准单元库(1)

这章节主要讲述了单元库描述的时序信息,单元应为标准单元。除了标准的时序信息,单元库描述的信息还有单元面积、功能,这些虽然与时序没有直接的关系,但是会在RTL综合时发挥重要作用。这章节中,我们只关注与时序和功耗计算有关的信息。

2024-09-23 21:17:14 2224

原创 STA 静态时序分析 第二章——静态时序分析的有关概念

STA 静态时序分析的有关概念

2024-09-22 21:45:25 2140

原创 STA 静态时序分析 第一章——简介

什么是STA(静态时序分析)?串扰以及噪声会对电路产生如何的影响?分析的有关方法在哪个阶段使用?并且是如何使用的?

2024-09-22 14:34:32 921

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