TI高精度实验室ADC系列培训视频 第2章 ADC驱动拓扑

本文详细介绍了SAR型ADC的不同输入结构,包括单端输入、伪差分输入、全差分输入和真差分输入的特点及应用场景。此外还对比了电阻型和开关电容型输入阻抗结构的区别。

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2.1 SAR型ADC输入类型

单端输入结构的输入信号是相对于地来测量的。在这个例子中AD 的正输入端连接到了输入信号,负端连接到了地。有的器件地线是和内部结构连接在一起,只有一个输入端 。
伪差分输入结构的输入信号是相对于满量程的一半来测量的。在这个例子中满量程为 3V,AD 的负输入端连接到了满量程的一半,即1.5V±100mV。正输入端可以在负输入端的上下进行摆动,产生正负差分输入信号。
因此对于伪差分输入型器件,它的输出数字代码是有符号的,因为它存在正负两种情况。同理,对于单端输入结构,它的输出代码均是无符号的,因为它的所有输入信号都是正的。
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差分信号等于正输入电压减去负输入电压。图中这两个输入电压都是 0V 和 5V,但是它的差分输入范围是±5V。所以差分输入范围是每个输入电压的两倍
共模电压是两个输入电压的平均值,简单的计算方法就是将两个电压相加除以2,共模输入电压是数据转换中非常重要的一个限制参数。
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全差分输入结构:输入差分信号为正输入减去负输入,差分输入范围是两倍的输入电压。在这个例子中每个数端的信号为 0 到 5V,那么差分数范围就是 ±5V 或者 10V,需要注意的是共模电压是固定的,它等于满量程的一半,共模输入电压的精度是非常重要的,一般允许误差范围为 ±100mV。信号总是关于共模电压对称的,在这个例子中共模电压为 2.5V,输出电压关于 2.5V 进行对称。
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真差分输入结构与全差分类似,最主要的区别在于真差分结构允许任意的共模电压范围,而全差分结构共模电压必须为满量程的一半。这里展示的是ADS8881的例子,两个输入电压是相互独立的,输入范围为正输入减去负输入,需要注意的是共模电压可以在整个范围内变化,同时也可以看得出,输入信号并没有关于共模电压对称,全差分数据结构是一种非常常见的结构。
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单极性结构只允许正输入信号,而双极性允许正负两种输入,需要注意的是
这里的极性都是相对于地面来说的。
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单极性和双极性是根据输入信号相对于地面来定义的,与是否差分无关。 差分器件输入有负,并不代表器件为双极性。
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SAR 型 ADC两种主要的输入阻抗结构:电阻型和开关电容型。
开关电容型由开关和电容组成的采样保持电路构成,一般情况下采样和保持的时间非常短,这里是 300ns。所以需要一个外部的宽带放大器放置在输入端以使输入信号在整个捕获周期内达到合适的精度,这里使用的是一个 20M 的放大器。还需要注意的是,这种结构的输入阻抗是 RC 构成的动态阻抗而不是一个固定电阻,开关电容型结构的 SAR 型 ADC 输入范围等于参考电压。运算放大器的选择和 RC 电路的设计是这类 ADC 的一个难点。
对于电阻型、高压型、PGA 输入型 ADC 器件,其内部集成了一个缓冲放大器或可编程放大器。通常来讲这个放大器应配置在差分结构中使 ADC 的输入阻抗等于差分结构的输入电阻,这个例子中它的输入阻抗为 1MΩ,这种类型的输入结构比开关电容输入结构有一个非常重要的优点:那就是它内部集成了 ADC 驱动缓冲器,消除了对外部高速放大器的要求;另一个优点是输入范围可以大于参考电压。在这里插入图片描述

2.2 单端驱动电路分析、反向配置与轨对轨放大器的交越失真(未看)

2.3 交越失真(未看)

2.4 仪表放大器驱动ADC(未看)

2.5 全差分放大器驱动ADC(未看)

### DSP 中 PWM 与 ADC 的实现原理及应用 #### 1. ePWM 模块的功能概述 DSP中的增强型脉宽调制(ePWM)模块是一个高度灵活的外设,能够生成精确的PWM波形并提供多种控制功能。它具有六个完相同的ePWM模块,每个模块可以产生两路PWM输出信号EPWMAEPWMB以及两个ADC启动触发信号SOCASOCB[^1]。这些特性使得ePWM不仅适用于电机控制、电源管理等领域,还可以与其他外围设备协同工作。 #### 2. PWM 输出机制 ePWM模块的核心在于其定时器单元,该单元负责生成周期性占空比可控的PWM波形。具体来说,通过设置CMPA寄存器来定义高电平持续时间,而PRD寄存器则决定了整个PWM周期长度。当计数值达到CMPA时,输出状态发生改变;到达PRD后重新开始新一轮循环。此外,死区插入逻辑允许安驱动拓扑结构下的功率器件。 #### 3. ADC 配置详解 对于TI TMS320F280049C系列微控制器而言,内置了三个独立运作但又相互关联紧密的模数转换器——ADCA、ADCBADCC[^2]。每一个这样的组件都具备如下特点: - **辨率**:均为12比特精度; - **输入模式**:仅限于单端测量方式而不兼容差分形式; - **多通道能力**:各自配备多达十六条线路用于接入外部传感器或者内部节点电压检测用途; - **同步性能**:得益于精心设计架构,在单一硅片之上实现了并发采集可能性亦或是单独执行任务选项之间切换自如的能力。 #### 4. S+H 及 转换阶段解析 在实际运行过程中,从物理世界获取连续变化量直至最终获得离散表示需经历两个主要环节—采样保持(Sample-and-Hold)与量化编码(Quantization)。前者依赖系统局时钟(SYSCLK),后者依据本地专用频率源(ADCCLK)推进进程。值得注意的是,为了保证数据质量,开发者应当合理调整预频因子(PRESCALE)以形成适配目标应用场景需求的有效速率组合方案。同时也要注意满足最短维持窗口宽度要求以免引入额外误差成影响整体表现效果。 ```c // 设置ADCCLK 频系数 AdcaRegs.ADCCTL2.bit.PRESCALE = PRESCALE_VALUE; // 定义S/H 时间参数 (单位为SYSCLK 周期数) AdcaRegs.ADCSOC0CTL.bit.ACQPS = ACQUISITION_TIME; ``` 上述代码片段展示了如何利用软件手段调节相关硬件资源配策略从而达成预期目的之一例证说明而已并非详尽无遗版本呈现出来供大家参考学习之用罢了。 #### 5. 综合运用案例析 在一个典型的三相逆变器控制系统里,可以通过配置不同的ePWM模块别对应各相IGBT开关元件栅极驱动信号的同时安排好相应的电流反馈路径连接至对应的ADC输入端口完成闭环调控流程构建作业。此时借助恰当设定好的中断服务程序(ISR)响应时机点读取最新一轮转化成果进而实施进一步计算处理动作即可有效提升动态响应速度指标水平并且降低稳态偏差幅度范围等等诸多优势特征体现出来。 ---
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