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本文介绍了如何利用TCL语言在Vivado中进行FPGA设计，包括设置环境变量、启动Vivado的不同方式以及基本TCL语法。重点讲述了通过TCL脚本编译生成IP核和block design工程的步骤，以zedboard为例，详细解析了配置2017.4版本在Linux下HDMI输出显示的流程，并提供了相关库的源码加载方法。
AXI stream接口通常用于高性能应用程序，AXI stream可以通过DMA与 ZYNQ AXI HP 接口一起使用， PYNQ的DMA类支持AXI DMA IP，这允许从DRAM读取数据，并将其发送到AXI stream，或从stream接收并写入DRAM。
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