VIVADO中封装基于AXI4_LITE总线接口IP核注意事项

本文详细介绍IP核的创建、编辑、综合、更新及测试流程,包括使用manageIP方式创建IP,选择EditIP进行编辑,封装前综合代码,以及如何处理mergechange。同时,文章还提到了向导生成的IP核包含测试文件和h文件。

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1.以manage ip的方式创建

Tools>create and package...,配置该IP 的名称,并且选择该IP 的保存路径。默认的IP 核存放路径与manage IP 的工程路径是一个层次。

建议以后养成习惯:专门建一个manage IP工程,在此工程下Tools>create and package...且选择IP路径时,在ip_repo下新建一个文件夹,即每个IP单独一个文件夹,便于管理。

 

2.封装时选择edit ip

【注意】这里一定要选择“Edit IP”,否则,软件只是生成了框架文件,而不会创建一个关于IP 核的工程,这样对于IP 核的进一步设计很不利,虽然可以人为创建一个工程将相应的文件加入,但是这个需要更强的经验。所以强烈建议这一步选择“Edit IP”。

 

3.封装前先综合

跟纯PL 开发流程类似,代码写完了,要运行综合,检查编写的代码是否能够综合成功。 避免IP加到新工程中综合实现时才报错。

 

4.merge change

因为我们修改了软件自动生成的两个文件,软件认为会对Customization Parameters 页面,Ports and Interfaces 页面,Customization GUI 页面等产生影响,因此显示图标如下:

相关的页面左侧图标标识有修改标记,右上方也有提示更新的操作入口。

在任何一个页面点击上面的更新操作,其他页面也会同步更新。除非更新所涉及到的文件跟其他页面无关。更新成功后,显示图标变为绿色对勾。

 【注意】如果修改代码后,这些页面不更新,说明你是直接打开的IP 核工程文档,而不是在Manage IP 模式下。

 

5.向导生成的IP有对应的测试文件和h文件

用户自定义IP 的驱动程序框架也是由向导生成的,开打BSP 工程的libsrc,可以看到添加的模块驱动文件。

 

### VivadoAXI4 逻辑接口的使用教程与配置说明 #### 创建一个新的 AXI4 外设 IP 为了创建一个新的 AXI4 外设 IP,在 Vivado 工具栏中选择 `Tools` -> `Create and Package New IP...` 并点击下一步,直到选项卡允许创建一个基于 AXI4 的外设[^2]。 #### 修改 IP 基本信息 在向导引导下完成基本设置之后,进入新打开的工程环境来调整 IP 的基本信息。这一步骤对于定制化需求至关重要,确保所设计的功能能够满足特定的应用场景要求[^4]。 #### 添加自定义参数和用户端口定义 针对具体应用的需求,在指定的位置添加必要的自定义参数以及用户端口定义。这些更改通常涉及到硬件描述文件中的特定行数,例如在较旧版本(如2018.2)中可能是在第7行附近加入自定义参数声明;而在接近底部的部分,则用于定义额外的输入/输出信号连接。 #### 实现用户逻辑部分 实现用户逻辑是整个过程中最心的一环。这部分工作主要集中在处理来自或去往 AXI 接口的数据流上。通过编写相应的 HDL 代码片段,可以构建起复杂的读写控制机制或是简单的寄存器映射关系。下面是一个简化版的例子展示了如何在一个模块内部管理来自 AXI 总线的操作: ```verilog // 用户逻辑部分示例 always @(posedge S_ACLK or negedge S_ARESETN) begin : proc_s_axi_lite_wdata if (~S_ARESETN) begin reg_data <= 'b0; end else if (s_axi_awvalid && s_axi_wvalid && s_axi_bready && !axi_awaddr_wr_ena_reg) begin case (s_axi_awaddr[ADDR_LSB+OPT_MEM_ADDR_BITS:ADDR_LSB]) default : reg_data <= s_axi_wdata; endcase end end ``` 此段代码实现了当接收到有效的写命令时更新本地寄存器的内容,并且只有在地址解码匹配的情况下才会执行实际的数据转移动作。 #### 综合与打包 IP 最后一步是对修改后的项目进行综合验证无误后,返回至初始界面并通过 `Package IP` 功能项来进行最终封装。在此期间还需要按照提示逐步完善有关文档资料等内容以便后续集成测试阶段顺利开展。
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