FPGA笔记（二）

最新推荐文章于 2025-04-27 16:24:17 发布
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分类专栏： FPGA 文章标签： fpga 初学FPGA RTL级建模 verilog描述
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本文链接：https://blog.youkuaiyun.com/Struggle_For_M/article/details/51453552
博主分享了自己学习FPGA的心得，从简单的LED闪烁开始，通过RTL级建模和Verilog描述实现逻辑功能。文章介绍了计数模块和LED显示模块的设计，强调了理解数字逻辑并用代码描述的重要性。

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      #对FPGA的一些理解
经过一周对FPGA的了解，对Verilog语法已经有一定的了解了，自己也写了些程序，但是感觉自己写出来的硬件描述语言程序不是那个味儿，就像一段式状态机跟三段式状态机相比一样，在我这所有的逻辑都放在一个always进程中，虽然目的都能达到，但是这么下去，越大的运用中会带来越大的问题（习惯的养成很重要）。我用Verilog建模（个人也倾向于不把Verilog的硬件描述当做写程序）跟写程序一样的感觉，在心中没有数电的思想，不能通过由逻辑电路图到Verilog描述（电路——>描述），不知啥时候才能有这种思路（我觉得这才是Verilog的真谛）。个人觉得FPGA更像是一堆pmos、nmos构成的电路，要一个非门就拿一个cmos，所有的逻辑门都可以由mos管构成，我们只是把他们通过一定的关系链接起来。所以，数电才是思想，Verilog只是实现手段，而FPGA是个试验台。


#一周的总结
永远的StreamLed！

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FPGA学习笔记
zevjay的博客
05-13 1391
FPGA（Field-Programmable Gate Array，现场可编程门阵列）作为数字系统设计领域的明星，以其灵活性和高性能受到广泛青睐。本文旨在深入浅出地介绍FPGA的核心理论概念、学习过程中常见的问题及易错点，并提供实用建议帮助你避免这些陷阱。同时，我们还将通过代码示例让你对FPGA编程有更直观的理解。
FPGA 学习笔记
chuckfql的专栏
11-30 449
1. 计数器学习 module my_counter(clk,rstn,led);    input clk;  input rstn;  output reg led;   reg[24:0] count;      always@(posedge clk,negedge rstn)      if(rstn == 1'b0)       count = 1'b0;
FPGA学习笔记(一)
一个小白的博客
07-12 809
实现一个数字电路模块
FPGA笔记.pdf
02-05
FPGA入门笔记，根据野火FPGA征途系列开发板所带的DEMO，根据自己学习过程整理的核心资料，供大家学习
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- **AC620开发板**: 由小梅哥团队精心打造的第二代FPGA学习套件，旨在帮助初学者更好地理解和掌握FPGA技术。 - **芯航线团队**: 联合创始人暨上海V3学院的王建飞老师（梦翼师兄）为FPGA的学习提供了宝贵的指导和支持...
FPGA自学笔记
06-25
AC620开发板是由小梅哥团队精心打造的第二代FPGA学习套件，提供了实际操作的硬件平台，帮助学习者通过实践加深对FPGA的理解。开发板的推出得到了众多专家和机构的支持与协助，包括芯航线团队联合创始人王建飞老师、...
FPGA学习笔记（二）FIR 设计
qq_55811090的博客
04-27 588
介绍了FIR概念，介绍MATLAB与FPGA怎么进行联合设计FIR滤波器。
小梅哥FPGA自学笔记
02-06
小梅哥的FPGA自学笔记是一份非常宝贵的资源，尤其对于初学者来说，它提供了深入浅出的FPGA学习路径。FPGA（Field-Programmable Gate Array）是一种可编程逻辑器件，允许用户根据需求定制电路，广泛应用于通信、图像...
FPGA自学笔记--设计与验证
04-23
非常详细的FGPA设计指导书，Verilog程序，包含初学者接触的各种内容。
FPGA学习笔记（FPGA基础知识）
spx1164376416的博客
08-25 9722
1.FPGA的最基本单元 1、查找表（LUT） （组合逻辑单元） LUT指显示查找表（Look-Up-Table)，本质上就是一个RAM。它把数据事先写入RAM后，每当输入一个信号就等于输入一个地址进行查表，找出地址对应的内容，然后输出。 2、D 触发器 （时序单元） 3、基于 SRAM 工艺，内部结构为查找表 2.FPGA的物理结构 目前主流 FPGA 主要 基于 SRAM 工艺查找表技术。 FPGA 芯片主要由以下模 块构成。 可编程输入输出单元（IOB）简称 IO 单元，为芯片与外接电路的接口
【FPGA自学笔记】
【FPGA学习笔记】--串口发送模块的设计与验证
01-20 1083
写这篇博客的目的，是为了记录笔者在自学FPGA路上的点点滴滴，也是为了让自己充满动力，在学习FPGA的路上保持兴趣和热情。当然，也希望能和广大网友一起交流，共同进步。 从今日起，【FPGA自学笔记】会不定时更新。 ...
FPGA笔记（四）
老七_的博客
05-29 1362
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FPGA笔记(7)
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有什么见解或者不对的地方，欢迎大家帮我指正出来 2020年7月16日09:15:12 组合逻辑和时序逻辑的区分： 组合逻辑：运行该命令的时候，不是通过时钟的上升沿或者下降沿来触发运行的，是通过命令中的条件的变换就触发运行该命令 时序逻辑：指的是由时钟触发 例子： 组合逻辑： 1： assign d =a & b； 2： always@（*）//*号也可以换成b or c or d d =a & b； 对于上述命令，每次执行这段命令，只有当b，c，d中的其中一个变换状态的时候，才会执行
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小梅哥fpga自学笔记
最新发布
05-23
### 关于 FPGA 自学笔记的小梅哥资源 小梅哥的 FPGA 学习资源是一套非常全面的学习材料，适合初学者入门以及深入理解 FPGA 的开发流程和技术细节。以下是针对您需求的具体说明： #### 资源概述 小梅哥提供了两部分内容供学习者参考：一是 **FPGA 自学笔记资源下载**[^1]，二是 **书本源码**[^2]。前者包含了完整的自学笔记和相关文档，后者则专注于 Verilog 实践代码。 - **自学笔记资源下载**: 提供了详细的 FPGA 学习指南，涵盖了基础概念、硬件描述语言 (HDL) 编程技巧以及实际项目的实现方法。您可以访问该项目地址获取更多详情：https://gitcode.com/open-source-toolkit/c2820。 - **书本源码**: 针对《小梅哥 FPGA 自学笔记》一书中提到的实际案例进行了代码化处理，帮助读者更好地理解和应用理论知识。此部分特别适合希望快速掌握 Verilog HDL 的新手开发者。项目链接如下：https://gitcode.com/open-source-toolkit/246b8。 #### 技术要点解析 除了上述资源外，在具体技术层面还需要关注以下几个方面来提升您的 FPGA 开发能力： - **FPGA 架构与工具链熟悉程度**[^3]: 掌握现代 FPGAs 的内部结构特点及其配套软件环境至关重要。比如 Xilinx Vivado 和 Intel Quartus 是目前最流行的两款设计平台。 - **动手实操经验积累**[^4]: 结合具体的例子操作可以加深印象。例如创建 ROM 文件并将预定义的数据集加载进去的过程就是很好的练习机会之一。 另外还给出了一个简单的 3 到 8 解码器的设计实例[^5]: ```verilog module decoder_3_8( input a, input b, input c, output reg [7:0] out ); always @( *) begin case ({a, b, c}) 3'd0 : out = 8'b0000_0001; 3'd1 : out = 8'b0000_0010; ... default: out = 8'bxxxx_xxxx; // Add this line to handle undefined cases. endcase end endmodule ``` 以上展示了如何利用组合逻辑电路完成特定功能转换的任务。 ---
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