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本文详细介绍了如何在ZYNQ7020 FPGA上实现yolov3-tiny神经网络，通过HLS将网络各层封装为IP核，并在Vivado中调用。文章提供了设计的Block框图、仿真图，以及yolo_acc模块的代码。此外，还包括了完整的工程代码和测试代码。
本文介绍使用ZYNQ实现yolov3-tiny，下图为ZYNQ上ARM与FPGA交互框图：
通过HLS将设计得每层网络进行封装IP核，在vivado进行调用：下图为the convolution, accumulation, max pooling, upsample and yolo blocks之间得连接。
下图为vivado上设计block框图：
下图对其中一个模块yolo_acc模块得仿真图：
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