8位双向移位寄存器verilog设计

已于 2022-06-06 10:10:21 修改
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分类专栏： D1：verilog设计 文章标签： fpga开发 单片机 嵌入式硬件
于 2020-12-27 19:20:20 首次发布
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该博客介绍了如何使用Verilog设计一个8位双向移位寄存器，包括并行输入数据、数据左移、右移和清空功能。通过Key1控制数据输入，Key2和Key3控制移位方向，使用同步时钟信号Clk和异步清零信号Reset。设计中还包含了按键去抖动处理和使能信号的控制逻辑。

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设计实现功能
设计一个8位双向移位寄存器，实现并行输入数据、数据左移、右移、清空数据的功能。

程序主要包括

一， Key1 控制拨码输入：

a) key_flag1, key_state1实现Key1去抖（if(key_flag1 && (!key_state1))）；
b) key_cnt [3:0]从0开始在每一次Key1 按下后加1，累积到3后再按下Key1, key_cnt 清零；
c) en_num1为高4位输入使能信号，en_num2为低4位输入使能信号，en_num3为输入确认使能信号（都为高水平有效）；
d) key_cnt 的数值控制c)中3个使能信号的值；

二， Key2 , Key3控制移位方向：

a) 按键去抖同Key1 a)；
b) turn_left为左移使能信号，turn_right为右移使能信号（都为高水平有效）；
c) key_cnt 的数值控制c)中3个使能信号的值；

三， Clk 同步时钟信号，Reset异步清零：

 

 本程序用verilog编写，在quartusII上完成。

 

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