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1、并发语句集合
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Veilog
有典型的并发语句集合initial
语句:在整个仿真时间内只执行一次,initial 语句之间都是并发的always
语句:可以对组合电路和时序电路进行建模,always语句之间都是并发的assign
语句:可以对组合电路进行建模,assign 语句之间都是并发的begin...end
:语句从上到下,顺序执行fork...join
:语句并行执行,与语句顺序无关
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fork...join
fork...join
语句块可以创建并行执行的进程;两个fork...join
在initial
中begin..end
之间,两个fork...join
是串行的关系,如果两个fork...join
两个外围又是fork...join
,那么两个fo