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原创【数字IC基础】跨时钟域（CDC，Clock Domain Crossing）

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2023-02-23 00:52:15 28878 15

原创【数字IC基础】一文搞懂AXI (Advanced eXtensible Interface) 协议

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2023-02-17 19:13:24 8559 1

原创【数字后仿】isolation Cell基础

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2024-04-01 22:26:05 383

原创【数字IC前端笔试真题精刷（2023）】专栏内容规划

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2023-07-18 09:54:50 1052

原创【数字IC前端笔试真题精刷（2021）】大疆——数字芯片开发工程师A/B卷

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2023-07-18 09:32:26 931

原创【数字IC前端笔试真题精刷（2020）】大疆——数字芯片开发工程师B卷

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2023-07-18 09:30:32 726

原创【数字IC前端笔试真题精刷（2020）】大疆——数字芯片开发工程师A卷【详细解析】【必刷卷】

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2023-07-17 09:49:34 872

原创【数字IC论文研读】QSN—A Simple Circular-Shift Network for Reconfigurable Quasi-Cyclic LDPC Decoders（循环移位网络）

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2023-07-02 20:41:46 1382

原创【verilog基础】用状态机解决交通灯问题

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2023-06-22 22:39:29 1214

原创【verilog基础】时钟无毛刺切换电路 Clock Glitch Free

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2023-06-22 19:30:05 1500

原创【verilog基础】单比特毛刺滤除电路

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2023-06-22 18:00:00 846

原创【Verilog基础】仲裁器（固定优先级仲裁器Fixed Priority Arbiter、循环仲裁器Round Robin Arbiter）、找最高位/最低位的1的位置

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2023-06-22 16:55:00 1022

原创【数字IC基础】SPI（serial peripheral interface，串行外围设备接口）协议、I2C（Inter-Integrated Circuit）协议、UART通信协议一文详解

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2023-06-19 17:53:52 423

原创【数字IC基础】IR DROP学习总结（含笔试真题实战）

然而，设计中的某些部分的同时翻转又是非常重要的，例如时钟网络和它所驱动的寄存器，在一个同步设计中它们必须同时翻转。，从而降低总体的电阻，因此可以降低 IR Drop。也可以这么想：增大电源网络的密度，即增加电源线和地线的数量，可以提高电源网络的分布均匀性和电源供应的容量，从而改善电压降。参考答案：B【静态电压峰通常表示电源网络中某点的最大静态压降，平均压降则是整个电源网络中所有点的静态压降的平均值】可能会导致一些时序问题。所以，不能降低 IR Drop 的选项是【B】增加cell density。

2023-05-10 13:18:19 1761

原创【数字IC前端笔试真题精刷（2022.7.3）】蔚来——数字IC设计工程师

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2023-05-09 21:33:23 1065

原创【数字IC前端笔试真题精刷（2022.7.7）】燧原——AI芯片验证工程师

【数字IC前端笔试真题精刷（2022.7.7）】燧原——AI芯片验证工程师

2023-05-09 14:42:29 1158

原创【数字IC前端笔试真题精刷（2022.8.14）】大疆——数字芯片开发工程师B卷

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2023-05-09 02:53:35 1312

原创【数字IC前端笔试真题精刷（2022.7.28）】芯动——数字IC验证工程师（1号卷-验证）

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2023-05-08 00:16:45 2080

原创【数字IC前端笔试真题精刷（2022.7.3）】蔚来——数字IC验证工程师

【数字IC前端笔试真题精刷（2022.7.3）】蔚来——数字IC验证工程师

2023-05-07 17:24:45 851

原创【数字IC前端笔试真题精刷（2022.8.7）】大疆——数字芯片开发工程师A卷

【数字IC前端笔试真题精刷（2022.8.7）】大疆——数字芯片开发工程师A卷

2023-05-06 00:33:44 1531

原创【从零开始学习 UVM】12.8、UVM RAL（续更） —— UVM RAL Model 实战项目（基于AXI总线的寄存器读写实例）

【从零开始学习 UVM】12.8、UVM RAL（续更） —— UVM RAL Model 实战项目

2023-04-10 21:40:10 739

原创【从零开始学习 UVM】12.7、UVM RAL（续更） —— UVM RAL模型全局声明和内置定义

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2023-04-10 21:40:03 568

原创【计算机组成原理】Cache缓存：高速缓冲存储器

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2023-04-09 15:39:25 668

原创【Verilog基础】二进制比较器

2、当位数较多且要满足一定的速度要求时，可以采取。

2023-04-06 20:22:51 3068

原创【从零开始学习 UVM】12.6、UVM RAL（续更） —— RAL Predictor

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2023-04-04 19:48:34 704

原创【从零开始学习 UVM】12.5、UVM RAL（续更） —— RAL Adapter

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2023-04-04 17:43:39 1199

原创【从零开始学习 UVM】12.4、UVM RAL（续更） —— 更新镜像值、期望值的方法介绍【如：read/write/mirror/update/set/get/predict/reset】

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2023-04-04 17:32:14 974

原创【从零开始学习 UVM】12.3、UVM RAL（续更） —— RAL Classes & Methods

【从零开始学习 UVM】12.3、UVM RAL（续更） —— RAL Classes & Methods

2023-04-04 17:18:50 487

原创【从零开始学习 UVM】12.2、UVM RAL（续更） —— RAL Model 结构

【从零开始学习 UVM】12.2、UVM RAL（续更） —— RAL Model 结构

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原创【从零开始学习 UVM】12.1、UVM RAL（续更） —— Register Abstraction Layer (RAL) Model概述

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原创【从零开始学习 UVM】11.5、UVM Register Layer —— 后门访问实战项目（RAL实战，交通灯为例）

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2023-04-04 16:18:09 1292

原创【从零开始学习 UVM】11.4、UVM Register Layer —— UVM Register Model 实战项目（RAL实战，交通灯为例）

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2023-04-04 15:34:29 405

原创【从零开始学习 UVM】11.3、UVM Register Layer —— UVM Register Environment

【从零开始学习 UVM】11.3、UVM Register Layer —— UVM Register Environment

2023-04-04 14:43:26 649

原创【从零开始学习 UVM】11.2、UVM Register Layer —— UVM Register Model（RAL，Register Abstraction Layer，寄存器抽象层）概述

【从零开始学习 UVM】11.2、UVM Register Layer —— UVM Register Model（RAL，Register Abstraction Layer，寄存器抽象层）概述

2023-04-04 11:57:51 283

原创【从零开始学习 UVM】11.1、UVM Register Layer —— Register Layer 概述

【从零开始学习 UVM】11.1、UVM Register Layer —— Register Layer 概述

2023-04-04 11:41:09 335

原创【从零开始学习 UVM】10.11、UVM TLM —— 在 TLM 中使用 _decl 宏

【从零开始学习 UVM】10.11、UVM TLM —— 在 TLM 中使用 _decl 宏

2023-04-04 03:05:18 299

原创【从零开始学习 UVM】10.10、UVM TLM —— TLM Sockets

【从零开始学习 UVM】10.10、UVM TLM —— TLM Sockets

2023-04-04 02:54:46 239

原创【从零开始学习 UVM】10.9、UVM TLM —— TLM Analysis Port

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2023-04-04 02:42:41 763

原创【从零开始学习 UVM】10.8、UVM TLM —— UVM TLM Example

【从零开始学习 UVM】10.8、UVM TLM —— UVM TLM Example

2023-04-04 01:57:35 562

原创【从零开始学习 UVM】10.7、UVM TLM —— TLM Fifo [uvm_tlm_fifo]

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2023-04-04 01:34:26 654

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