RFSOCZU47DR核心板

西安彼睿电子-数模混合系统解决方案的配套服务商 Zynq UltraScale + RFSoC 西安彼睿 IW-RFSOC-47DR 数模混合信号处理卡,采用 Xilinx ZYNQ UltraScale + RFSoC ZU47DR,可以访问大型 FPGA 门密度,8 个 ADC / DAC 端口,可扩展 I / O端口和 DDR4 内存,适用于各种不同的可编程应用,带有 ZU47DR FPGA 的彼睿板卡IW-RFSOC-47DR 由 8 个 14 位,采样率 5GSPS ADC 和 8 个 14 位,采样率 10 GSPS DAC端口提供支持。 阅读详情
AI摘要

本文介绍了基于XILINX XCZU47DR-2FFVE1156I处理器的RFSOCZU47DR核心板,包含8个RF-ADC和8个RF-DAC通道。文章详细讲解了核心板的供电设计、时钟配置及多种启动方式,适用于低功耗、实时处理的射频系统开发。

采用XILINX的XCZU47DR-2FFVE1156I处理器,拥有8个RF-ADC、8个RF-DAC通道。提供完整的应用示例源代码和性能分析工具,主要用于小尺寸、低功耗、实时处理RF系统的快速集成与应用部署,缩短产品开发周期,提供了丰富的板载资源。

如下列出了核心板所有板载资源,以及核心板的尺寸信息。

核心板供电

核心板供电电压范围是8-12V,推荐供电电压为8V,在核心板的两个角都留有电
源输入管脚,电源管脚在模块内部已做了连通,此设计是为了方便底板的电源接入,
设计时只需要连接一个角上的电源管脚,核心板即可工作。电源连接需用铜皮连接且
打足够的过孔以保证电源通流能力。核心板上的所有GND 信号都需要连接到底板上,
每个GND 通过两个过孔与底板连接。核心板供电极限电流在5A,所以外部供电需要
考虑极限电流情况以保证核心板工作稳定。
给模组供电的电源输出电压需要稳定,在模组电源输入加一级DCDC 电源转换,
从高电压转到8-12V(推荐8V),DCDC 电流输出能力可以选6A 及以上。在模组电源输
入处需放置2 颗220uF/25V 电容保证电源质量。

核心板时钟

核心板为 PS 侧提供了 33.333333Mhz 的时钟输入,输入的管脚位置为 PS_REF_CLK;
为PL 侧提供了200Mhz 的差分时钟输入, PL 侧的时钟输入管脚是
IO_13P_GC_66/IO_13N_GC_66,管脚位置是 AL9/AM9;另外 ZU47DR 其他部分我们采用了专
用的时钟芯片产生ADC/DAC/GT/PL 端各个部分的时钟需求,如下图分别列出了各部分时钟
的管脚连接。

核心板启动方式

主芯片支持JTAG、QSPI Flash,SD,EMMC四种启动模式,四种启动模式可以根 开
据发板上的拨码开关选择,更详细说明可参考提供的核心板原理图。

RFSoC应用XCZU47DR八发八收FPGA设计方案 本文介绍了基于Xilinx XCZU47DR RFSoC芯片的八发八收FPGA设计方案。该方案采用集成射频数据转换器的SoC架构,支持8路14bit ADC(5GSPS)和8路14bit DAC(9.85GSPS),可直接处理5GHz以下射频信号。硬件设计包含高性能输入缓冲器、QMC校正和复杂混频器,适用于5G/6G通信、雷达、卫星通信等领域。文章详细阐述了ADC/DAC子系统参数,包括通道配置、采样率、带宽等特性,并提供了FPGA顶层模块的硬件接口设计,展示了多通道数据收发处理能力。该方案无需外置混频器, 阅读详情

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