(八) 基于cadence 617 简单差分电路仿真

提示:文章写完后,目录可以自动生成,如何生成可参考右边的帮助文档


前言

提示:以下是本篇文章正文内容,下面案例可供参考

1. 电路原理图

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2. 仿真设计

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设置PIN端Vin1,Vin2为变量
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说明 Vin1的直流电压是VCM1,同理设置Vin2
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怎么加入变量呢
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3. 建立输出

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现在定义Vo1 - Vo2
同样添加输出就在里面设计,复制改数字就完了
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4. 参数扫描

给VCM1一组值来仿真一下输出输入
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V出现直线 可以按q矫正点位
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如何移出曲线
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现在观察尾电流不同时,输入输出关系,横坐标的变量放在第二列
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我们设置VCM2 = 0 ,实际上VCM1就是差模输入电压 .也就是差模电压放在横坐标,看电流源不同的曲线
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我在想如果VCM2不是0,而是一个变化的值,该怎么样设计呢?是要在直流仿真Design Variable设计VCM2,再去参数扫描VCM1吗?这样当VCM1 = VCM2就是共模电压了

### Cadence IC 设计中的电阻负载差分放大器 在Cadence平台下设计电阻负载差分放大器涉及多个方面,包括原理图绘制、参数设定以及仿真验证。下面将详细介绍如何利用Cadence工具完成这一任务。 #### 原理图创建 启动Cadence Virtuoso环境后,新建项目并选择合适的工艺库文件。接着进入ADEXL界面建立新的电路模块,在此过程中定义好电源电压节点VDD与接地GND,并放置两个N沟道MOSFET作为输入级晶体管Q1和Q2形成差动对[^3]。为了提供偏置电流,还需要增加一对共源极配置的P沟道MOSFET Q3和Q4充当主动负载角色。最后添加外部反馈网络由电阻Rf构成闭合环路控制增益稳定性的同时也起到直流耦合作用防止自激振荡发生。 ```verilog // Verilog-A code snippet for defining MOSFETs and resistors in a differential pair setup. module diff_amp; parameter real Vdd = 5; // Supply Voltage mos q1(n0, n_in_pos, vss); // N-channel input transistor mos q2(n1, n_in_neg, vss); pmos q3(outp, n0, vdd); // P-channel active load pmos q4(outn, n1, vdd); resistor r_fbk(outp, outn, value='1k'); // Feedback Resistor endmodule ``` #### 参数调整优化 针对具体应用场景需求合理选定各元器件数值至关重要。对于本案例而言,重点在于确保差模增益足够大而共模抑制比CMRR尽可能优异。这通常意味着需要精心挑选镜像比例因子β=gmro/gmri使得两部分之间存在适当差异从而获得理想性能指标。此外还需注意温度系数补偿措施以维持静态工作点稳定不变受外界因素干扰较小。 #### 仿真流程概述 构建完毕后的模型应当先执行DC Sweep扫描操作检验是否存在明显失配情况;随后开展AC Analysis频域响应曲线描绘确认带宽范围满足预期目标;最终借助Transient Simulation瞬态波形观察进一步评估动态特性表现是否符合规格书规定要求。整个环节都离不开精确可靠的SPICE netlist支持,因此务必保证前期建模无误以免后期反复修改浪费时间精力。
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