
手写IP核
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FPGA十年老鸟
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手撕IP核系列——Xilinx FIFO IP核-异步FIFO
以前从来没有这么细扣过,认识比较肤浅,通过几天对Xilinx IP核的仿制,对异步FIFO有了更深刻的认识。一开始,我是希望做到时序完全一模一样的,在某些间隔读和间隔写的场景中,也确实做到了输出时序完全一模一样,但发现在有些读和写同时进行的场景,有些输出就是与异步FIFO IP核会有差距。尽管最终我还是放弃追求完全和IP核的时序保持一致了,但通过这几天的手写和研究,也能写出功能正确的异步FIFO出来下面,将描述实现的一些过程,我们以一个IP核的设置作为参考。.........原创 2022-08-09 23:55:20 · 3307 阅读 · 1 评论 -
手撕IP核系列——Xilinx FIFO IP核-同步FIFO
提示:文章写完后,目录可以自动生成,如何生成可参考右边的帮助文档。原创 2022-08-05 15:10:33 · 1272 阅读 · 0 评论 -
手撕IP核系列——Xilinx FIR IP核之一
在Xilinx和Intel平台的FPGA中提供了给我们各种各样的IP核,这些IP核都是厂家的成熟设计,使用起来也非常的方便。但因为我们的项目经常存在跨平台的问题,两家的IP核从参数、时序到风格都有一些区别,越复杂的IP核越难以移植,特别是如果两家的IP核输入输出的时序不一致的话会导致设计需要改动很大。因此有必要对IP核进行RTL描述,1、 通过自己的代码写出了IP核的功能,对IP核的实现进行了深入的理解。......原创 2022-08-05 14:56:16 · 3923 阅读 · 2 评论