axi-stream data fifo 的使用方式

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分类专栏： zynq 文章标签： fpga开发
于 2022-05-17 12:18:50 首次发布
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本文详细介绍了AXI-Stream接口的基本原理，包括tvalid和tready信号的重要性，以及附加信号如tuser、tlast和tkeep的功能。接着，文章重点讲解了AXI-Stream DATA FIFO的作用，作为输入输出接口为AXIS的缓冲器，用于跨时钟域数据传输和避免亚稳态。最后，提到了实际工程应用、仿真、源码链接和参考资料。

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一、axi-stream 接口介绍

二、axi-stream接口信号
AXI Stream关键的只有两根信号线，及tvalid核tready。tvalid是主设备驱动的信号，表示Stream上的数据是有效的，tready由从设备驱动，表示从设备下一个时钟到来时能够接收数据。AXI Stream的特点是这两个信号不存在互相等待的关系，及数据传输只发生再两者均有效的时候，从而效率很高，可以认为是连续传输，避免了死锁的情况。

AXI Stream还有一些附加信号，通常是伴随再数据中传输，主要包括tuser，tlast，tkeep等。tlast在标准流协议中表示一个数据包结束，伴随最后一个数据传出，tuser可以很多位，是用户定义信号，用来表达用户自己需要传输的数据。tkeep是字节修饰符，位数位数据宽度/8，当总线数据某字节有效时，tkeep对应位就为高。
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三、axi-stream data fifo 介绍
AXI4 STREAM DATA FIFO是输入输出接口均为AXIS接口的数据缓存器，和其他fifo一样是先进先出形式。可以在跨时钟域的应用中用于数据缓冲，避免亚稳态出现。支持数据的分割和数据拼接。
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四、工程
五、仿真
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