能够降低功耗的SoC设计方法

最新推荐文章于 2024-08-17 10:38:30 发布
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本文探讨了SoC设计中的功耗问题，包括动态功耗和静态功耗的概念，以及在系统级、RTL级和布局布线阶段降低功耗的设计策略，如并行运算、时钟门控和操作数隔离等。

首先，需要清楚的是对于SoC设计，其总功耗包含两个部分：动态功耗以及静态功耗。

  • 动态功耗是指当芯片处于活动态即芯片中的信号值发生变化时所消耗的功耗。
  • 静态功耗是指芯片仍然保持供电但不处于活动态即芯片中信号值没有发生变化时所消耗的功耗。对于CMOS设备，静态功耗是由于漏电流导致的。

低功耗在目前的IC设计中是十分重要的问题，涉及到的细节有很多，下面只是列举典型的能够降低功耗的设计方法。

系统级
  • 并行运算
  • 流水线
RTL级
  • 时钟门控
  • 操作数隔离
综合
  • 插缓冲
  • 相位分配
布局布线
  • 将翻转高的节点用寄生电容较小的金属层来布线
欢迎补充、交流……
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