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转载 数字前端是什么？就业如何？学习路径怎么安排？一文搞定所有疑问！
现在最火的程序员职位是什么？？我不得不告诉你，是优秀的数字前端！随着中兴事件和华为事件的爆发，国内掀起了一股芯片热，很多公司开始进军芯片设计领域，资金、技术开始大量涌入，芯片设计人才供不应求。数字前端已经取代了前几年红得发紫的移动开发者，成为程序员新贵！放眼全球，不仅在国内的互联网行业，在国外，数字前端工程师一样是需求旺盛、供不应求的香饽饽。这些高薪的热门岗位，竞争也是十分激烈；对于应聘者的要求也是十分高的，想要提升面试技巧，可至>>>移知PC端官网，资料下载专区，搜索“面试资料
2021-01-08 23:06:02
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原创 coresight（一）coresight简介
一、coresightcoresight是ARM公司提出的，用于对复杂的SOC，实现debug和trace的架构。该架构，包含了多个coresight组件。众多的coresight组件，构成了一个coresight系统。我们也可以根据coresight架构，实现自己的coresight组件。每个coresight的组件（component），都要遵循coresight架构的要求。1、 典型的一个coresight的环境以下是一个典型的coresight环境，包含了两个ARM core，一个DSP，和
2020-08-16 11:43:48
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原创 FPGA开发基础：详解状态机的类型、设计与实现（附代码示例）
特性MooreMealy输出依赖仅当前状态状态+输入响应速度较慢（时钟同步）更快（组合逻辑）资源消耗通常较少可能更多适用场景稳定控制快速响应掌握状态机设计是FPGA开发者的必备技能。建议根据具体需求选择状态机类型，结合时序报告进行优化。欢迎在评论区交流讨论！关键词#FPGA#状态机#Verilog#数字电路#硬件设计。
2025-04-01 18:41:00
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原创 上海芯片企业列表
上海主要的芯片企业列表（按业务领域分类，共40家），涵盖设计、制造、封测、设备和材料等全产业链环节（SMIC）• 中国最大晶圆代工企业，全球第四大芯片代工厂，14nm/28nm成熟制程主力厂商• 全球第二大智能卡IC代工厂，拥有8英寸和12英寸生产线• 专注车规级芯片制造，华大半导体旗下特色工艺晶圆厂• 沪硅产业子公司，中国最大的12英寸半导体硅片供应商• 全球领先的5G通信芯片设计商，手机基带芯片市占率全球前五• CMOS图像传感器（CIS）设计龙头，全球前三CIS供应商。
2025-03-28 16:28:19
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原创 推荐FPGA从业者的必学项目之ISP图像处理
图像信号处理（ISP）技术是智能视觉系统的核心，而FPGA凭借其独特的硬件优势，正在成为ISP领域的关键技术载体。例如，Xilinx的UltraScale+系列FPGA能通过流水线设计，以每时钟周期处理128个像素的速度完成实时4K视频的Demosaic（去马赛克）算法，而传统CPU需要依赖多线程调度，难以达到同等效率。这种跨领域认知能显著提升方案竞争力。某安防厂商的测试数据显示，使用Arria 10 FPGA实现H.265编码+ISP预处理，功耗仅为ASIC方案的70%，同时保留了算法升级的可能性。
2025-03-27 19:13:42
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原创 记一次数字前端设计面试（含问题和verilog设计）
同步复位和异步复位也各有特点。同步复位呢，优点在于复位信号的作用和时钟同步，这样能保证系统在时钟的有效沿进行复位操作，使得电路状态变化更加稳定和可预测。异步复位就不一样，它不管时钟状态如何，只要复位信号有效，就立马进行复位操作，这在一些需要快速响应复位的场景很有用。要避免复位信号毛刺，可以采用一些方法，比如对复位信号进行滤波处理，或者使用专门的同步电路来处理复位信号，让它在进入关键电路前变得稳定。打个比方，就像一个简单的加法器电路，输入两个数字，立马就能得到它们相加的结果，输出和之前的输入状态没啥关系。
2025-03-26 10:42:35
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原创 静态时序分析圣经翻译计划——第一章：绪论
静态时序分析（简称STA）是用来验证数字设计时序的技术之一，另外一种验证时序的方法是时序仿真，时序仿真可以同时验证功能和时序。“时序分析”这个术语就是用来指代“静态时序分析“或”时序仿真“这两种方法之一，简单来说，时序分析的目的就是为了解决设计中的各种时序问题。STA被称为静态的原因是其对于设计的分析是静态地执行的，并不依赖于施加在输入端口上的激励。
2025-03-19 14:45:24
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原创 一篇文章重新认识电子设备的大脑：SoC芯片的奥秘
在我们日常使用的手机、智能手表和汽车中，都藏着一颗指甲盖大小的超级芯片——SoC（片上系统）。它如同电子设备的"全能心脏"，将计算机的大脑（CPU）、图形处理器（GPU）、内存等数十个部件集成在单一芯片上，创造了现代电子设备的性能奇迹。
2025-03-18 17:14:04
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原创 数字IC/FPGA校招笔试题解析（一）
在同步电路中，降低时钟频率虽能通过增加时序裕量减少毛刺被采样的风险，但并非从根源消除毛刺。异步电路中，毛刺仍可能被下游电路捕获。多bit数据因各bit传输延迟不同，直接采样可能导致数据错位。多bit数据总线无法直接通过寄存器同步处理，需采用专用同步结构（如AFIFO）或编码方式（如格雷码）。本文按题目顺序编排，每道题独立成段，包含问题、选项、答案及解析。无符号数比较器的硬件逻辑对称，仅决策点不同（判断高位为1或0），面积差异可忽略。任务可调用函数，但函数不可调用任务（因函数需即时返回，任务可能含时延）。
2025-03-12 17:31:47
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原创 模拟ADC架构大起底，我们应该学习哪些模拟ADC内容呢？
【引言】模拟世界的“翻译官”——没有它，数字系统将“听不见”现实当心电图机的电信号变成医生屏幕上的波形，当麦克风的声音化作手机里的音频文件，背后都藏着一个关键技术：ADC（模数转换器）。它是现实世界与数字系统的“翻译官”，更是模拟芯片设计的皇冠明珠。但工程师的痛，谁懂？高速、高精度、低功耗“既要又要”，选错架构直接翻车；技术迭代飞快，稍不留神就被行业淘汰……别慌！今天我们从两大主流架构（SAR ADC和Sigma-Delta ADC）拆解设计秘诀，助你弯道超车！
2025-03-06 19:50:36
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原创 FPGA实战项目如何选？这份指南助你精准匹配职业方向
FPGA（Field-Programmable Gate Array）即现场可编程门阵列，是一种通过硬件描述语言（如Verilog）重新定义电路结构的芯片。与传统CPU的固定架构不同，FPGA就像电子工程师的「数字乐高」——你可以自由组合逻辑门、存储器、DSP单元等模块，构建专属的硬件加速器。FPGA开发者的核心竞争力在于"硬件思维+系统视角"。无论选择哪个项目，建议遵循"兴趣驱动→技能叠加→行业深耕"的三步法则。我们的课程支持个性化项目组合，帮助学员构建完整的FPGA技术矩阵。
2025-02-28 16:58:40
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原创 备战春招—数字IC FPGA笔试题（3）
为了帮助大家更好地备战春招，在继前两期分享一系列数字IC和FPGA笔试题之后，现推荐新系列——**数字IC FPGA笔试题（3）**
2025-01-27 12:06:03
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原创 精通PCIe技术：协议解析与UVM验证实战
掌握PCIe协议在现代电子设计领域极为重要，它不仅对SoC的设计验证、FPGA的设计、还是系统级的开发都能提升效率。
2025-01-23 10:38:14
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原创 备战春招—数字IC、FPGA笔试题（2）
深入解析一系列典型的数字IC与FPGA面试题目。通过详细的题目分析、解题思路展示和相关知识点的扩展，我们旨在为求职者提供一个全面的面试准备指南。
2025-01-20 13:50:21
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原创 SoC芯片架构揭秘：从Arm核心到高速通信
深入探讨SoC芯片架构的关键组成部分，包括Arm处理器的微架构基础、Armv8-A和Armv9-A处理器架构的高级特性、DDR3内存子系统的优化策略，以及PCIe协议在I/O子系统中的实现。
2025-01-16 15:20:39
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原创 备战春招—高频芯片设计面试题
本文将提供一些高频芯片设计面试题的精选示例和满分答案。这些内容不仅涵盖了核心概念，还深入探讨了实际应用中的考虑因素，旨在为应聘者提供一个全面的准备指南，
2025-01-13 17:17:52
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原创 备战春招—FPGA 2024年的面试题库
精心整理了FPGA 2024年的面试题库，涵盖了SDRAM设计、FPGA内部组成、LE查找表实现原理、全局与局部时钟域等多个方面的知识点。
2025-01-08 15:57:46
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原创 数字IC设计高频面试题
1.什么是cache一致性2.指令乱序是出现在什么情况下是，怎么实现的3.在AX|中如果2个master和4个slave，master的ID有3位那么转换到slave后ID变成几位
2025-01-06 14:15:24
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原创 Arm Cortex - M3 MCU 全流程设计：从前端到后端全方位掌握
只是简单的掌握MCU是不够的，企业的招聘岗位要求是熟悉，或者精通，且每个岗位之间要掌握的技术不一样
2025-01-02 14:43:11
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原创 备战春招 | 数字IC FPGA笔试题
包括竞争冒险现象的消除、异步时钟数据采样的正确方法、同步与异步电路设计的差异、亚稳态的处理、Verilog编程的注意事项、功耗优化策略，以及如何准备数字IC/FPGA工程师的面试。
2024-12-30 14:58:00
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原创 探索Verilog HDL：数字集成电路设计的关键
Verilog HDL和VHDL是两种主流的HDL语言。与VHDL相比，Verilog HDL在系统级和RTL级的设计中更为灵活和高效。VHDL虽然在逻辑门级和开关电路级有其优势，但在更高层次的设计中，Verilog HDL的灵活性和易用性使其成为了设计师的首选。
2024-12-24 10:34:10
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原创 数字设计工程师学习路线：从基础到高阶的全面指南
成为一名优秀的数字设计工程师，**需要经历从基础到高级的系统学习过程**。以下分享一份精心规划的学习路线，涵盖了从基础到高级的各个阶段。帮助有志于成为数字设计工程师的学习者系统地提升自己的技能。
2024-12-19 15:31:28
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原创 模拟电路Cascode OTA设计
一起学习如何通过DC和AC分析来优化放大器的性能，如何在设计中做出明智的Trade-Off，以及如何通过精心设计的Pole-Zero Doublet来提高系统的稳定性和响应速度。
2024-12-16 17:30:59
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原创 探索级联CMOS运算放大器的设计：提升电源抑制比（PSRR）与共模输入范围
随着技术的进步，对运算放大器的性能要求也在不断提高，尤其是在电源抑制比（PSRR）和共模输入范围这两个关键指标上。传统的两级CMOS运算放大器虽然在许多应用中表现出色，但在交流电源抑制比方面存在不足，尤其是在正电源轨上。
2024-12-12 16:33:54
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原创 DFT深度解析：从理论到实践的全面掌握
DFT的核心目标是降低测试成本，提高测试的覆盖率和诊断能力，它涉及到从设计初期就考虑测试的需求，包括可控制性和可观测性的增强，以及故障模型的构建和测试向量的生成。
2024-12-09 14:14:06
611
原创 SD控制器设计：从协议到RTL实战，精通数字IP设计
提供一个从SD协议SPEC到RTL设计实践，掌握较复杂的数字IP设计与验证的学习平台，从SD协议的深入解析出发，引导你一步步深入到外设IP的需求分析、规格定制，直至实现一个功能完备的数字IP设计。
2024-12-05 11:14:28
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原创 深入理解AMBA总线协议（入门篇）
AMBA总线知识是工程师们不可或缺的工具箱中的一把瑞士军刀。掌握AMBA总线的设计，意味着能够更灵活地设计数字系统，更高效地集成IP核，实现系统性能的优化，并适应不同的应用场景。
2024-12-02 13:59:29
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原创 从实战出发，精通Cache设计与性能优化
学习掌握不同类型的Cache结构和实现，含多端口Cache、多发射等，理解Cache的基本原理和各个组成部分的功能。掌握状态机设计和流水线优化的理论基础，设计更高效的硬件状态机和流水线结构，掌握异常处理和缺失处理的策略。
2024-11-27 10:10:32
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原创 深入探索Arm处理器：从基础到SoC设计的实战指南
Arm处理器是一系列基于精简指令集计算机（RISC）架构的中央处理单元（CPU），Arm处理器广泛应用于各种设备中，包括智能手机、平板电脑、嵌入式系统、微控制器、服务器和更多。
2024-11-21 16:55:13
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原创 CS DAC的Matlab建模与电路设计
在设计CS DAC时，Matlab建模是一个非常重要的工具，它可以帮助工程师在实际电路制作之前预测和优化电路的性能。
2024-11-18 15:46:35
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原创 基于运放的模拟集成电路设计
基于运放的模拟集成电路设计是电子工程领域中的一个重要分支，它涉及到**设计和实现用于模拟信号处理的集成电路**。运算放大器（Op-Amp）是模拟集成电路设计中的核心组件之一，它不仅能够放大微弱的模拟信号，还能通过不同的配置实现多种复杂的信号处理功能。广泛应用于信号放大、滤波、模拟计算等众多领域。
2024-11-14 15:13:47
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原创 掌握UPF技术：全面打通Cadence和Synopsys低功耗设计流程
UPF是一种标准化的低功耗设计格式，广泛应用于低功耗设计流程中。它定义了一套完整的低功耗设计规则和方法。它允许设计工程师通过编写UPF文件来定义和管理芯片的低功耗特性，如电源门控、隔离单元等。掌握UPF文件的编码方法、调试方法以及基于UPF文件的芯片物理实现和时序功耗分析流程，对于芯片设计工程师来说至关重要。
2024-11-11 15:51:46
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原创 人工智能大潮下的企业与个人目标定位
AI芯片是AI的底层硬件基础，AI也在反哺芯片的设计和制造。AI给芯片行业带来的第一个变革影响就是芯片设计的智能化
2024-11-07 15:23:49
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原创 深入浅出NoC技术，从原理到实战全面剖析！
以MPSoC系统为背景，深入探讨总线互联通信技术的精髓，围绕处理器体系结构及网络技术的融合。内容涵盖了NoC的八大维度，详细阐述设计NoC所需的基本知识和实现方法，能较全面地掌握NoC设计方法。
2024-11-04 11:31:52
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原创 备战秋招：2024 数字 IC 设计工程师面试题解析
一般公司的数字 IC 设计工程师秋招面试流程通常包括技术面和 HR 面。首轮技术面往往以自我介绍开场，随后面试官会围绕求职者的**专业知识和项目经验**进行深入提问。
2024-10-31 16:44:41
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原创 DFT专家带你初识DFT
本文将分享移知公开课《DFT专家带你初识DFT》，旨在深入探讨DFT技术的核心概念、实施策略以及未来发展趋势，为从事芯片设计的工程师和相关专业人士提供全面的技术指导和参考。
2024-10-29 14:35:45
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原创 时钟电路设计与CTS约束设计
本篇为你分享移知公开课《时钟电路设计与CTS约束设计》，此次课程由资深工程师主讲，内容涵盖了时钟设计的重要性、基于后端实现的时钟电路设计、时钟约束设计以及CPS的基础知识。
2024-10-24 17:59:39
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原创 SAR ADC面试攻略：关键技术解析与面试问题全攻略
本文将梳理SAR ADC项目中的关键技术和常见面试问题，为准备面试的你提供一个全面的技术准备指南。从采样开关的设计选择到CDAC的定量计算，从时钟抖动的影响分析到比较器的性能仿真，每一个环节都能在面试中展示你的专业知识和实践经验。
2024-10-22 10:45:35
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