【ZYNQ-7000开发之十三】中断：私有定时器中断

上篇文章实现了了PS接受来自PL的中断，本片文章将在ZYNQ的纯PS里实现私有定时器中断。每个一秒中断一次，在中断函数里计数加1，通过串口打印输出。

*本文所使用的开发板是Miz702(兼容zedboard)
PC 开发环境版本：Vivado 2015.2 Xilinx SDK 2015.2*

中断原理

中断对于保证任务的实时性非常必要，在ZYNQ里集成了中断控制器GIC(Generic Interrupt Controller).GIC可以接受I/O外设中断IOP和PL中断，将这些中断发给CPU。
中断体系结构框图图下：

软件中断(SGI)

SGI通过写ICDSGIR寄存器产生SGI.

共享中断SPI

通过PS和PL内各种I/O和存储器控制器产生。

私有中断（PPI）

包含：全局定时器，私有看门狗定时器，私有定时器以及来自PL的FIQ/IRQ。本文主要介绍PPI，其它的请参考官方手册ug585_Zynq_7000_TRM.pdf。
ZYNQ每个CPU链接5个私有外设中断，所有中断的触发类型都是固定不变的。并且来自PL的快速中断信号FIQ和中断信号IRQ反向，然后送到中断控制器因此尽管在ICDICFR1寄存器内反应的他们是低电平触发，但是PS-PL接口中为高电平触发。如图所示：

私有定时器

zynq中每个ARM core都有自己的私有定时器，私有定时器的工作频率为CPU的一半，比如Miz702或者zedboard的ARM工作频率为666MHZ,则私有定时器的频率为333MH