eSPI学习笔记

本文介绍了eSPI(Enhanced Serial Peripheral Interface)技术,作为CPU与低速外设之间的新型通信总线,它在一主多从的架构下兼容SPI并引入通道概念,支持上升沿采样。eSPI提供了CRC校验,并包含两个复位信号。其传输速率(TAR)为2个时钟周期,是LPC和ISA总线的升级替代方案。

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前言

CPU与低速外设之间最早是ISA总线,后来被LPC取代,现在LPC也不够看了,eSPI就出现了。
eSPI:Enhanced Serial Peripheral

  • 一主多从。在这里插入图片描述

  • 兼容SPI总线。

  • 通道的概念。

  • 上升沿采样。
    在这里插入图片描述

  • CRC是一定要发的,但是接收方可以忽略。

  • Master有两个复位信号,一个用来发送复位信号给从,一个用来接收从模块发送的复位信号。
    在这里插入图片描述

  • TAR = 2 clock

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