该博客通过Intel的双口RAM IP核进行时序仿真，重点在于A口的写操作和B口的随后读操作。在设置好关键参数后，通过Verilog代码模拟了向A口写入数据0, 1, 2，并从B口读取，验证了写操作的即时性和读操作的一个时钟周期延迟。"
132580099,9311708,matlab实现陀螺仪加速度计信号融合测姿,"['matlab', '传感器', '信号处理', '物理计算', '数值模拟']
使用的Intel提供的双口RAM IP核 进行同时钟源的时序仿真针对A口写操作，B口读操作
双口RAM设置如下（只给出了部分关键设置）注意双口RAM数据和地址是互通的，即用A口去向某地址写数据，用B口去读B口的相应地址，即可读到A口写的数据。
进行的第一个时序仿真：为向A口地址0,1,2依次写入数据 ，之后用B口去读A口的数据
`timescale 1ns / 1ns
module dual_ram_tb ;
reg [4:0] address_a;
reg [4:0] address_b;
reg cloc
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