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最新推荐文章于 2023-10-03 15:19:18 发布

eachanm

最新推荐文章于 2023-10-03 15:19:18 发布

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分类专栏： HDLBits题目文章标签： verilog

本文链接：https://blog.youkuaiyun.com/eachanm/article/details/130590987

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该文描述了如何使用一个4对1多路复用器和最少数量的2对1多路复用器，根据给定的Karnaugh图来构建电路。设计中，输入c和d被用作多路复用器的选择器输入，实现了一个名为top_module的部分，该部分的输出mux_in根据c和d的值映射了Karnaugh图的逻辑功能。

摘要生成于 C知道，由 DeepSeek-R1 满血版支持，前往体验 >

对于下面的Karnaugh图，根据需要使用一个4对1多路复用器和尽可能多的2对1多路复用器给出电路实现，但使用尽可能少。不允许使用任何其他逻辑门，必须使用 a 和 b 作为多路复用器选择器输入，如下面的 4 对 1 多路复用器所示。

您只实现了标记为top_module的部分，使得整个电路（包括 4 对 1 多路复用器）实现了 K-map。

For the following Karnaugh map, give the circuit implementation using one 4-to-1 multiplexer and as many 2-to-1 multiplexers as required, but using as few as possible. You are not allowed to use any other logic gate and you must use a and b as the multiplexer selector inputs, as shown on the 4-to-1 multiplexer below.

You are implementing just the portion labelled top_module, such that the entire circuit (including the 4-to-1 mux) implements the K-map.

module top_module (
    input c,
    input d,
    output [3:0] mux_in
); 
    always@(*)
        begin
            case({c,d})
                2'b00: mux_in <= 4'b0100;
                2'b01: mux_in <= 4'b0001;
                2'b10: mux_in <= 4'b0101;
                2'b11: mux_in <= 4'b1001;
                default:mux_in <= 4'b0000;
            endcase
        end

endmodule