Zynq-7000 PS到PL端emio的使用

最新推荐文章于 2023-10-03 22:00:41 发布
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分类专栏： FPGA学习记录 文章标签： zynq
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本文介绍了如何在Zynq-7000中使用EMIO（Extendable Multiuse I/O）来控制PL（Programmable Logic）端的LED。通过设置GPIO，配置EMIO引脚，并编写SDK代码实现MIO和EMIO端LED交替闪烁的实验。详细步骤包括ZYNQ Processing System的GPIO配置、生成约束文件、SDK编程等。

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Zynq-7000 PS到PL端emio的使用

作者：OpensLee

1 背景知识

上一节《Zynq-7000 ARM端MIO的使用》讲解了PS端MIO的使用，本节讲解ARM处理器通过emio(Extendable Multiuse I/O)控制PL端接口。如下图所示，ZYNQ-7000的GPIO分为两种（MIO,EMIO）。EMIO分布在Bank2和BANK3，共有64个引脚可以使用。

 

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如下图所示，当我们的MIO不够使用时我们可以使用EMIO，因为E

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ZYNQ-利用PS引脚实现EMIO GPIO的驱动
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将ZYNQ的EMIO映射到PS端串口1使用
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创龙Xilinx Zynq-7000 SoC高性能低功耗处理器，集成PS端单核/双核Cortex-A9 ARM + PL端Artix-7架构pdf
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本文用于讲解ZYNQ中的EMIO的作用以及使用方法。ZYNQ说明：1）ZYNQ分为PL侧与PS侧。2）PL侧为逻辑部分，即常说的FPGA。3）PS侧为软件侧，即常说的RAM侧。4）本文以ZYNQ-7000系列 xc7z045ffg676为例讲解EMIO。使用开发工具：vivado 2017.4 ，SDK本文例程：设置两个EMIO，第一个作为输出，点亮LED，第二个作为输入，输入KEY的电平。......
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ZYNQ学习之旅--PS_EMIO
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MYIR-ZYNQ7000系列-zturn教程(4)：gpio_emio
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开发板环境：vivado 2017.1 ，开发板型号xc7z020clg400-1，这个工程主要本章描述怎样通过EMIO引出GPIO， 并控制三色灯D34 （博客末尾为大家提供了网盘的工程源代码大家可以下载） step1 这是已经新建好的vivdao 工程 (如果大家不会新建vivado 工程请参考我上篇博文hello_worldhttp://blog.youkuaiyun.com/t...
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ZYNQ7000-GPIO EMIO中断实验 程序烧写后自动进一次中断的怪现象 试验硬件：正点原子领航者ZYNQ开发板（芯片xc7z020clg400-2） 试验软件：Vivado 2020.2与Vitis 2020.2 Vivado中的Block Design： 打开UART0，打开MIO与EMIO，EMIO位宽为1，正确设置DDR型号，设置FCLK为50MHz，VIO输出与EMIO输入对接，此时无需指定EMIO引脚，VIO输出默认为0。 Vitis中的代码： #include "xil_printf.
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同上讲，先给出如下的结构图，除 Bank1 之外的 Bank 都具有 32bit，Bank1 只具有 22bit 是因为总共只有 54 个 MIO，其中 32bit 的 Bank0 控制了 MIO[0~31]，剩下的 MIO[31~53]就由 22bit 的 Bank1 控制。接下来的步骤和之前一样，在这里就不再赘述了。如果想查看函数的定义，可以按住 Ctrl 键不放， 用鼠标点击相应的函数，就会跳转到其定义的地方。，可以看到，程序中PL的按键，用的是BANK2的EMIO0，在之前也提到了，因此标号是。
【ZYNQ7000学习之旅 - 01】EMIO练习
qq_40057229的博客
09-06 366
ZYNQ7000 EMIO练习参考背景准备功能生成XSA文件编写APP总结 参考 xilinx ug1165 pynq z-2 用户手册 背景 zynq7000 MIO有53个，在BANK0和BANK1，并且直接与PS相连；EMIO有64个，在BANK2和BANK3，与PL相连；PS可以通过EMIO连接PL端的引脚。 准备 Vivado2020.1 Vitis2020.1 pynq z-2 功能 使用PL端口的SW0和LED1，SW0作为AXI GPIO，LED1作为EMIO；SW0的切换实现LED
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