【innovus基础】手修drc之——金属跳层/修改线宽

原创 于 2025-06-29 20:09:20 发布 · 813 阅读 · 1 ·
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#硬件架构

在遇到天线效应问题的时候，我们可能需要通过切线以及向上跳层来解决
想要具体了解天线效应，请参考——什么是天线效应

1、跳层
选中需要更换层次的net，然后输入editChangeLayer -layer_vertical M3
即可换到对应的层次(M3)，并自动打上通孔
在这里插入图片描述
2、修改线宽

同样，选中net后，editChangeWidth -width_vertical 0.44

代码与文字齐飞，逻辑共创意一色！若我的文章让你会心一笑，点个赞我们一起笑谈"IC人生"！qxOWwKbl1tTzkyu.png

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Innovus
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Innovus 是 Cadence 公司推出的一款数字后端实现工具，广泛应用于数字集成电路的物理设计流程中。它支持从逻辑综合后的网表到最终版图生成的全流程设计，包括布局规划（Floorplanning）、电源网络设计（Power Plan）、时钟树综合（Clock Tree Synthesis）、布局（Placement）、布线（Routing）、时序分析（Timing Analysis）以及物理验证（Physical Verification）等关键步骤 [^3]。 ### 功能介绍 #### 1. 布局规划（Floorplanning） Innovus 提供了灵活的布局规划功能，用户可以定义芯片的整体布局结构，包括核心区域（Core Area）、I/O 引脚位置、宏单元（Macro）摆放等。合理的布局规划有助于优化芯片面积、功耗和性能。 #### 2. 电源网络设计（Power Plan） Innovus 支持多电源域设计（Multi-Supply Voltage Design），可以创建复杂的电源网络结构，包括电源域（Power Domain）、电源开关（Power Switch）和电平转换器（Level Shifter）等，以实现低功耗设计目标 [^2]。 #### 3. 时钟树综合（Clock Tree Synthesis, CTS） Innovus 的时钟树综合功能可以生成低偏斜（Low Skew）和低抖动（Low Jitter）的时钟网络，确保整个设计的时序一致性。用户可以通过设置时钟约束（Clock Constraints）来优化时钟网络的性能。 #### 4. 布局（Placement） Innovus 支持自动和手动布局功能，能够根据设计规则和时序约束将标准单元（Standard Cell）放置在合适的位置，以优化时序、功耗和布线拥塞。 #### 5. 布线（Routing） Innovus 提供了高性能的布线引擎，支持全局布线（Global Routing）和详细布线（Detailed Routing），能够处理复杂的互连结构，确保设计满足物理设计规则（DRC）和电气规则（ERC）。 #### 6. 时序分析与优化（Timing Analysis and Optimization） Innovus 集成了静态时序分析（Static Timing Analysis, STA）功能，能够分析设计的时序路径并提供优化建议。用户可以通过时序驱动的布局和布线来满足设计的时序目标。 #### 7. 物理验证（Physical Verification） Innovus 支持设计规则检查（DRC）、版图与网表一致性检查（LVS）等物理验证功能，确保最终版图符合制造要求。 ### 使用指南 #### 启动 Innovus 启动 Innovus 的命令通常如下： ```bash innovus -no_gui -execute_flow ``` 该命令将以无 GUI 模式启动 Innovus，并执行预定义的设计流程。若需要图形界面，可省略 `-no_gui` 参数。 #### 设计流程概述 1. **读取设计**：加载设计网表（Netlist）、时序约束（SDC 文件）和工艺库（Technology File）。 2. **布局规划**：定义芯片布局、电源网络和宏单元位置。 3. **电源网络设计**：创建电源域和电源网络。 4. **时钟树综合**：生成时钟树并优化时钟偏斜。 5. **布局**：将标准单元放置到芯片上。 6. **布线**：完成全局和详细布线。 7. **时序分析**：进行静态时序分析并优化设计。 8. **物理验证**：检查设计是否符合 DRC 和 LVS 规则。 #### 示例脚本 以下是一个简化版的 Innovus 自动化脚本示例： ```tcl # 读取设计 read_netlist my_design.v read_sdc my_design.sdc read_lib my_library.lib # 初始化设计 init_design # 布局规划 floorplan -r 1.0 0.6 10.0 10.0 10.0 10.0 # 电源网络设计 create_supply_net -name VDD -applies_to inputs -location {0 0} create_supply_net -name VSS -applies_to inputs -location {0 0} # 时钟树综合 create_clock -name clk -period 10.0 [get_ports clk] clock_tree_synthesis -buf_cell BUFX4 -target_skew 0.1 # 布局 place_design # 布线 route_design # 时序分析 report_timing -path_type full_clock # 物理验证 verify_drc verify_lvs ``` ### 注意事项 - **License 管理**：确保 Innovus 的 License 服务器正常运行，并且环境变量（如 `LM_LICENSE_FILE`）已正确设置 [^4]。 - **工艺库支持**：使用前需加载正确的工艺库文件（如 TSMC 或 SMIC 的 `.tf` 文件），以确保设计符合制造要求 [^1]。 - **性能优化**：对于大规模设计，合理配置内存和 CPU 资源可以显著提升运行效率。 ---
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