Jzoj4906 组合数问题

树莓派IgH EtherCAT主站部署与实时内核调优实战 本文详细介绍了在树莓派上部署开源IgH EtherCAT主站并进行实时内核调优的完整实战流程。通过编译实时内核(RT-Preempt)、交叉编译IgH主站、系统集成配置及性能优化,实现了低成本、高定制的工业控制解决方案,有效满足了EtherCAT通信对微秒级实时性的严苛要求。 阅读详情

题意:noip2016d2t1

我们考虑将每个数字质因数分解来做即可

线性筛求出所有2000以内的质数让后直接暴力分解即可,计算C(i,j)是否为k的倍数,最后加上前缀和

#include<stdio.h>
#include<string.h>
int w[500],c=0,n,m,t,k,pr[2010]={0};
int l[2010],f[2010][10][2];
int s[2010][2010],S[2010][2010];
void mul(int* v,int i,int d){
	for(int j=1;j<=l[i];++j) v[f[i][j][0]]+=d*f[i][j][1];
}
int main(){
	freopen("problem.in","r",stdin);
	freopen("problem.out","w",stdout);
	for(int i=2;i<=2000;++i){
		if(!pr[i]){ pr[i]=c; w[c++]=i; }
		for(int j=0;j<c&&i*w[j]<=2000;++j){
			pr[i*w[j]]=-1;
			if(i%w[j]==0) break;
		}
	}
	for(int x,i=2;i<=2000;++i){
		x=i;
		for(int j=0;w[j]*w[j]<=x;++j)
			if(x%w[j]==0){
				f[i][++l[i]][0]=j;
				for(;x%w[j]==0;x/=w[j]) ++f[i][l[i]][1];
			}
		if(x>1) { f[i][++l[i]][0]=pr[x]; f[i][l[i]][1]=1; }
	}
	for(int i=0;i<c;++i) if(pr[w[i]]!=i) puts("wrong");
	scanf("%d%d",&t,&k);
	int v[300];
	for(int i=1;i<=2000;++i){
		memset(v,0,sizeof v);
		for(int j=1;j<=i;++j){
			mul(v,i-j+1,1);
			mul(v,j,-1); s[i][j]=1;
			for(int x=1;x<=l[k];++x)
				if(v[f[k][x][0]]<f[k][x][1]) s[i][j]=0;
			S[i][j]=S[i-1][j]+S[i][j-1]-S[i-1][j-1]+s[i][j];
		}
		for(int j=i+1;j<=2000;++j) S[i][j]=S[i][j-1];
	}
	for(int a,b,i=0;i<t;++i){
		scanf("%d%d",&a,&b);
		printf("%d\n",S[a][b]);
	}
}

【教程4>第1章>第12节】通过Verilog读取txt格式数据进行测试并将结果导入到matlab 我们在verilog的testbench中,调用txt文件,将上述正弦样本数据作为测试激励输入到verilog模块中。通过这个方法,可以将一些较为复杂的数据导入到verilog中,进行FPGA数据处理模块的开发。即通过w方式打开一个新的txt文件,然后将verilog的输出保存到XY1.txt文件中。这个部分是txt文件的路径,实际使用时,修改为您自己的路径,或者将txt文件放在和我一样的路径中。这个是数据长度,matlab产生的txt多少长度,这个参数就修改为多少长度。这个txt就是保存这段数据的文件。 阅读详情

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