zynq系列之-----zynq平台的简易工程搭建

本文介绍了zynq平台的简单工程搭建,涵盖从pl端到ps端的工程。pl端使用原理图模式,通过一系列操作生成Verilog文件;ps端在sdk搭建完毕后导出hdf文件,新建工程并添加代码,还说明了在sdk中烧录bit文件和elf文件的方法,使用软件为vivado 2018.3。

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本文主要讲述 zynq平台的简单工程搭建,从pl端到ps端的工程。

这个工程要搭建一个ps端的iic接口,pl端个led灯接口。

使用的软件:vivado 2018.3.

pl端:

由于使用到了zynq,所以在pl端必须使用原理图模式搭建工程。

原创链接:xilinx的zynq平台的简易工程搭建_hhh_fpga的博客-优快云博客

支持转载。

1、所以在自己的工程中,"Create Block Design" 创建自己的zynq

2、在界面中添加

3、选择主时钟

4、选择bank电压,这个要和自己的原理图对应

5,选择iic和串口,串口是用于打印的。

6、选择ddr的配置,我的原理图中的ddr4型号是:MT40A512M16LY-075:E

7、添加GPIO的ip,可以使PS和PL能联通普通的io。这个就不说了。

8、都设置后,点击自动连接按钮,使其自动连线。

连接完之后的block如下图所示:我这里私自添加了一个pl端的iic。

9、确保没有错误后,点击“Generate Output Products”

10、再点击“Create HDL Wrapper”生成Verilog文件

这样我们刚刚创建的block就生成了我们熟悉的Verilog

ps端:

1、在pl端的sdk搭建完毕后,选择“Export Hardware”,导出hdf文件

2、导出后,使用Launch SDK 打开sdk的工程。

3、“Exported Location ”是刚刚导出的hdf文件位置。

“workSpace”是创建sdk工程的文件夹。

打开之后,新建工程

4、

“project name”自己取个帅气的名字。

“OS Platform”表示就是进行裸机运行。

然后添加自己的代码,就可以运行了。

5、自己编写C代码,这个也不说了。

然后还加上在sdk中烧录bit文件和sdk的文件;

1,在“xilinx-->program FPGA"中可以烧录bit文件。

2,在“run as --> 1Launch on Hardware”中烧录elf文件

### 关于 MT40A512M16LY-075 的数据手册规格参数 #### 基本概述 MT40A512M16LY-075 是一款由美光科技生产的 DDR4 SDRAM 内存模块。这类内存广泛应用于服务器、工作站和个人计算机中,因其出色的性能和稳定性而备受青睐。 #### 主要技术特性 - **容量**: 该型号单颗芯片容量为 512Mb (megabits),即 64MB。 - **位宽/组织结构**: 组织方式通常为 x16 或者 x8, 这意味着每个存储单元可以处理 16-bit 宽的数据路径或者 8-bit 宽的数据路径[^1]。 #### 工作电压与频率 - **供电电压(VDD)**: 正常操作下 VDD 和 VDDQ 都是 1.2V ± 0.06V。 - **最高工作频率**: 支持高达 3200 Mbps 的传输速率,在 JEDEC 标准定义下的 CL=22 模式下运行。 #### 封装形式 采用 FBGA (Fine Pitch Ball Grid Array) 封装工艺制造而成,具有良好的电气特性和机械强度,适合大规模自动化生产装配线使用。 #### 温度范围 商业级温度范围是从 0°C 到 +95°C;工业级别则可以从 -40°C 至 +105°C 不等,适用于不同环境条件的应用场景需求。 #### 可靠性指标 具备较高的可靠性和耐用性设计,能够承受长时间连续工作的考验,并且拥有较长的产品生命周期保障。 ```python # Python 示例代码用于展示如何解析上述信息并创建一个简单的字典来表示这些属性 memory_specifications = { 'capacity': '512Mb / 64MB', 'data_width': ['x16', 'x8'], 'voltage_supply': {'VDD': '1.2V ± 0.06V'}, 'max_frequency': '3200 Mbps @CL22', 'package_type': 'FBGA', 'temperature_range_commercial': '-40°C to +95°C', 'temperature_range_industrial': '-40°C to +105°C' } print(memory_specifications) ```
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