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RSS订阅原创 xdma 读写 ddr
XDMA IP（Xilinx Direct Memory Access IP）是赛灵思提供的一款硬件加速器，专为实现高效的直接内存访问（DMA）操作而设计，广泛应用于需要高速数据传输的场合，特别是在FPGA与主机之间或FPGA内部不同模块之间的内存传输。它能够通过PCIe接口进行数据的高速读写，支持多个DMA通道，并提供灵活的数据传输模式，如内存到内存、设备到内存、内存到设备等，可以适应不同的系统架构需求。
2025-04-07 22:25:28
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原创 YOLOV8(v11)GPU版本环境安装及模型训练
1.1安装CUDA通过命令提示符nvidia-smi右上角就是你显卡支持的CUDA的最高版本，以后下载低于这个数字的版本号就好。
2024-10-30 20:18:02
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原创 FPGA千兆以太网UDP收发状态机实现
接口描述//:发送时钟。:系统复位。：发送使能。:发送的数据，位宽为32位。:发送数据的字节数，单位是byte。:crc检验数据。//:发送结束使能。:fifo读数据请求。:发送字节数据有效信号。:发送的数据，单位是字节。:crc使能和清空信号。
2024-06-27 19:54:35
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原创 以太网知识理论学习
OSI定义了网络互连的七层模型（物理层，数据链路层，网络层，传输层，会话层，表示层，应用层），即OSI开放互连系统参考模型。每个层的功能不同，网络通信中各司其职，整个模型包括硬件和软件定义。值得注意的是：OSI模型只是理想分层，一般的网络系统只是设计其中的几层。在TCP/IP模型中，OSI模型被简化为五层。：利用传输介质为数据链路层提供物理链接，实现比特流的透明传输，使数据链路层不必考虑传输介质是什么。比如PHY芯片、网线、RJ45座子等。
2024-06-19 08:12:10
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原创 zynq学习笔记一：GPIO外设通过MIO输出
通过上图可知，gpio模块被分为四个bank，其中Bank0,Bank1,通过MIO引脚链接到外设，而Bank2,Bank3通过EMIO引脚链接到外部设备，通常是值PL，值得注意的是，Bank1只有22位，这是因为MIO总共只有54个引脚GPIO是一个外设，用来观测(输入input)和控制（输出output）引脚。MIO（multiuse i/o） 将来自ps外设和静态存储器接口的访问多路复用到ps的引脚。GPIO可以独立且动态的编程，作为输出/输入以及中断模式。软件通过一组存储映射的寄存器来控制io。
2024-01-20 20:12:54
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原创 MSP432串口通信
MSP432单片机通过串口通信与正点原子图床模块通信首先要了解通信协议，这里官方所给的资料中已经提到。在使用任何模块之前应该了解模块与单片机之间的通信协议。最常见的比如波特率，奇偶校验等等。但是只满足这些是不够的，有的模块通信过程中往往会有帧头帧尾的情况，这种情况下，我们就需要根据官方给的资料自己来写。话不多说，直接上代码：/*******************************@函数说明：满足图传模块与单片机通信协议@********************************
2021-08-03 19:40:56
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原创 32F4蓝牙小车可调速，亲测可用。
硬件部分主要的是stm32f07单片机，TB6612,蓝牙模块。思路部分首先需要了解各个模块的使用方法，比如要使用直流减速电机，就需要知道电机的相关驱动，如TB6612,LM298N，A4590等电机驱动。再深一步还需要了解这些驱动怎么使用。以及如何使用单片机输出PWM，如何用单片机和蓝牙模块通信。在使用之前配置相关的硬件条件时，应该注意什么问题等等。这里主要是利用32单片机驱动履带车车模，蓝牙控制可调速。代码部分MOTOR.C电机引脚初始化#include "motor.h" void
2021-06-10 11:41:07
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空空如也
空空如也
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