【异常处理】verilator安装时出现异常 make: *** [Makefile:195: verilator_gantt.1] Error 13

最新推荐文章于 2024-09-13 22:47:03 发布
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#verilator #chisel

在Ubuntu中安装Verilator工具执行make时出现报错，网上无相关解决办法。经分析，可能是从Windows解压并上传源代码到Ubuntu，解压时将 - 替换成 _ 所致。建议直接在Ubuntu上用git下载项目，还附上了Verilator安装教程。

在ubuntu中安装verilator工具时执行make出现该报错。
当我出现这个报错的时候我一脸懵逼，因为网上找不到相关解决办法。
后来想到我的verilator是从github上下载zip，然后解压后传到ubuntu上的，windows上解压我记得会把-替换成_，这可能导致了该问题的出现。所以直接在ubuntu上用git下载项目，避免windows上传源代码到ubuntu上。
附上verilator的安装教程

安装4.210版本Verilator
Leo ICer的博客
09-13 1988
最后our.v which is our SystemVerilog design file.这句不执行，用下一句（unset VERILATOR_ROOT # For bash）替代。-exe 和 sim_main.cpp wrapper文件，构建可执行文件。不使用apt-get安装，因为其版本太老。vim sim_main.cpp，放入下面代码。-Wall 降低警告标准线，会有更多警告报出来。一个.v 文件和.cpp文件，共同仿真。vim our.v，放入下面代码。出现：no rule。
【异常处理】Verilator报错Verilator requires a C++14 or newer compiler
VICI的博客
03-08 1052
riscv-mini是UC Berkeley用Chisel编写的三级流水线RISC-V处理器，它实现了RV32I的用户级2.0版本ISA和机器级1.7版本ISA，是Berkeley著名的Rocket-chip项目的简化版。
verilator_makefile的编写
kevin_wuminghao的博客
07-06 529
（3）目标：生成./obj_dir/V$(MODULE) 依赖：.sv 文件 .cpp文件。（2）目标：生成waveform.vcd 依赖：./obj_dir/V$(MODULE)（4）目标： clean (清除obj_dir 文件以及波形文件.vcd)（1）目标：生成波形文件 依赖：waveform.vcd 文件。目的：将程序执行之后生成的波形文件打开。cc : 将.sv文件转为C++文件。目的：将.mk文件转为可执行的文件。exe : 指定C++的测试文件。目的：执行生成的可执行文件。
SpinalHDL-sim Verilator Windows安装问题
xiangsiersheng0的博客
08-13 302
我是用着用着突然不能verilator 仿真了。 开始用的好好的。 https://blog.csdn.net/htgoco/article/details/103940200 根据这个链接我也初步定位是环境变量的问题。 但是无论怎么清理都不能解决问题。（用户环境变量） 后来开始对系统环境变量下手。 发现官方文档有一个这个图，上面说不能包含jre，我就把系统环境变量里的java 相关的删了， 发现可以了。 太折磨了， 莫名其妙。 ...
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weixin_70720143的博客
03-19 4595
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