【0.1基础的条件准备两周之后的数字IC前端设计校招面试】0.1进化到0.2——四句基本语法

本文介绍了如何在只有基础的条件下准备两周后的数字IC前端设计校招面试,重点讲解了Verilog的四句基本语法:定义变量、组合逻辑地基、时序逻辑地基和输入输出。内容包括wire和reg类型、assign和always@(*)的使用,以及如何写入基本代码。

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前言

最近课余时间辅导了一个承受着巨大压力裸辞转入IC设计行业的0.1基础小白,成功辅助她拿下两份薪酬还算客观的offer。在辅导的过程中思考了很多以前没有深究或是认为理所当然的问题,自己也收获颇多。鉴于这段经验还挺有意思的,所以记录下来:如何在只有0.1基础的条件下准备两周之后的数字前端IC岗校招面试呢?(以下均为我自己的经验与知识储备,全部是印象流的分析与结论,难免有错误或是疏漏之处,如有发现请指出并海涵,以便我及时修正不要误导他人。)

 

0.1基础是哪些

0.1基础是什么呢?我自己认为这个在大张旗鼓的准备面试之前,应该是已经具备了以下的基础知识的

 

  1. 基本的数学操作、逻辑操作与操作符知识,包括但不限于与、或、非、同或、亦或、移位、加减乘除取余、进位、按位操作等,对&|~!/%&&||^<<都要熟悉的和亲人一样;
  2. 十进制、二进制、十六进制与符号表示,数量的掌握三种进制之间的转换关系,4’b1101、10’d5、8’hFA、0xF0B1这类的数
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