FPGA两片RAM的乒乓操作

最新推荐文章于 2025-05-11 21:00:54 发布
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前言

在数据处理的一个周期内，为了避免同时对RAM读和写，因此利用乒乓操作将读写分开，在一个周期内仅对一片RAM读，对另一片RAM写，下个周期后再换回来。因此，实际上一片RAM的操作周期是两个数据处理周期。

代码释义

scyc ：数据处理周期
exsig ：ram切换信号
wsig ：ram写信号
rsig ： ram读信号
addr1 ：ram1读写地址
addr2 ：ram2读写地址
dat_i ： ram写数据
dat_o ：模块输出数据
时序图如下所示，在每个wsig和rsig信号来时，在exsig为高电平时写RAM1、读RAM2，当exsig为低电平时，写RAM2.读RAM1，由此避免了在一个scyc周期内对一片RAM进行读写。
在这里插入图片描述
具体实现代码如下：

always@(posedge clk,negedge rst_n)
	if(!rst_n) begin
		w1clk<=1'b0
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