门控时钟方法学

原创 已于 2025-03-29 19:04:23 修改 · 4.6k 阅读 · 75 ·
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#数字IC #IC验证 #fpga开发 #嵌入式硬件

于 2022-04-29 19:52:32 首次发布

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时钟的不断翻转会产生很大的翻转功耗，因此在某个模块不工作时及时地停下时钟常见的一种低功耗手段。

顾名思义就是为时钟输入增加一个使能en，详情如下

芯片设计进阶之路——门控时钟
6.4 Verilog RTL 级低功耗设计（下）
FPGA设计之门控时钟
门控时钟设计001：什么是门控时钟？如何产生门控时钟？
门控时钟设计002—门控时钟模块使用
门控时钟设计003：门控时钟降低了什么功耗

1. 结构

首先是门控时钟的电路实现

1.1. 与门门控

最简单的就是操作数隔离的方法，将时钟与en信号相与，通过控制en实现时钟门控

如下图

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