VCS和Verdi的调试

最新推荐文章于 2025-04-10 20:24:33 发布

Beyond Lau

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文章标签：科技

本文链接：https://blog.youkuaiyun.com/Pygmalion12/article/details/145873669

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一些有关选项

-debug_access: generate FSDB/VPD/VCD files for post-process debug
-debug_access +<option> : 可以控制debug的颗粒度

vcs_compile:
	${VCS} -f ${FILE_LIST} -sverilog -debug_access -timescale=1ns/100ps -kdb -nc -full64 -j32 -l vcs_compile.log

这样写就可以联合仿真啦！

确定要放弃本次机会？

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Beyond Lau

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VCS3 debug的基础

qq_37203178的博客

12-15

1154

VCS3

#VCS#关于＜-debug*＞和＜-debug_access*＞切记晕头转向

那么菜的博客

01-22

7298

为了仿真性能的提高，我们可以在编译时使用-debug_access+选项，来更好地控制仿真中调试的功能。与-debug_pp选项相比，-debug_access选项允许存储VPD和FSDB文件以进行后处理调试，并减少不必要的调试选项。可以使用-debug_access+指定其他选项，以有选择地启用所需的调试功能。只启用所需的调试功能，即可优化仿真性能。语法： debug_access(+<option>)* -debug_access支持的选项：选项描述 r The -d

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vcs仿真死循环debug

最新发布

qq_29362849的博客

04-10

256

以前以为return 语句只能用在函数的最后一行，但是实际上是逻辑的最后一行。满足return语句之后，后面的代码都不会执行。突然理解了为什么有些代码没看到 wuwuwuwu。vcs仿真提供死循环debug 的参数 +vcs+loopreport+10000 +debug_access_all。这是一个静态代码，可能会被vcs优化或者卡死，所以不会触发loopreport。仿真该module 卡住，添加上述编译选项并未报错。所以在编写循环时，建议开始结束前后添加打印，并且确认有合理的退出机制。

vcs编译选项debug_access对仿真时间的影响

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simprofile和debug_access的作用

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05-04

1万+

VCS的功能可以大致分为两个大类：编译和仿真。VCS编译的过程，就是经过一系列的操作，将verilog代码转换为可执行文件（.svim），接下来就是用dve进行仿真过程生成.vpd波形文件。VCS是编译型verilog仿真器，处理verilog的源码过程如下：VCS先将verilog/systemverilog文件转化为C文件，在linux下编译链接生成可执行文件，在linux下运行simv即可得到仿真结果。

verdi/vcs常用debug功能

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04-28

6258

记录verdi中常用的功能，以便自查使用

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亦安的数字小站

09-02

1161

简单汇总一些，具体可以执行vcs -help可以看到多数命令，更详细的请参阅相关手册。

uvm+vcs+verdi基本平台搭建

11-09

uvm+vcs+verdi基本平台搭建,也许平台不是很难，但是网上没有 UVM 在 VCS 中的详细教程，但是对于初学者就是一道屏障，我探索了几天，下文将一步一步的举例子说明 UVM+VCS+Verdi 的 liunx 平台搭建过程

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叫好与叫座虽然不是对立面，但想在同一个作品中达到双重效果很难。

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1.compile添加选项-assert enable_diag之后对应的下列run的选项才能使用： • -assert success （默认只打印assert fail的log，加上此选项后assert success的选项也会打印） • -assert maxsuccess=N（assert success的最大打印次数） 2.compile添加选项-assert enable_hier之后对应的下列run的选项才能使用： • -assert hier （可以enable和disable

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vcs和verdi

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<think>嗯，用户想比较VCS和Verdi这两款EDA工具的功能和差异。首先，我需要确认这两个工具的基本信息。根据引用[1]和[2]，VCS是Synopsys的仿真工具，而Verdi是调试平台。用户可能想知道它们各自的核心功能以及适用的场景。接下来，我应该分析它们的定位。VCS主要用于仿真，特别是数字电路的功能验证，支持编译型仿真，速度快。而Verdi专注于调试，提供波形查看、代码跟踪等功能。用户可能想知道为什么需要两个不同的工具，以及它们如何协同工作。然后，功能对比部分需要详细展开。比如，VCS的编译优化、覆盖率分析，而Verdi的图形化调试、事务级调试等。需要确保每个工具的特点都覆盖到，并且引用相关的资料支持，比如引用[2]提到VCS的高效仿真性能，引用[1]说明Verdi的调试效率。使用场景方面，VCS适合功能验证、回归测试，而Verdi用于问题定位、波形分析。用户可能关心在项目不同阶段如何选择工具，或者是否需要同时使用两者。根据引用[3]，VCS和Verdi可以集成使用，比如在仿真时生成fsdb文件供Verdi分析，这可能是常见的流程。此外，用户可能还想知道两者的技术差异，比如VCS是基于事件的仿真器还是其他类型，但根据现有引用，可能需要避免推测，只根据已有信息回答。比如引用[2]提到VCS是编译型仿真器，而Verdi是调试环境。最后，生成相关问题时要围绕用户可能的后续疑问，比如性能优化、集成方法、学习资源等，确保覆盖用户可能感兴趣的方向。</think>### VCS vs Verdi 功能对比与使用场景分析 #### 一、工具定位对比 | **维度** | **VCS** | **Verdi** | |----------------|--------------------------------------|--------------------------------------| | **核心功能** | 仿真引擎（编译型仿真器） | 调试平台（波形分析/代码跟踪） | | **设计阶段** | 功能验证阶段主导工具 | 验证调试阶段核心工具 | | **技术类型** | 编译型仿真器（支持SystemVerilog/UVM）| 图形化调试环境（支持FSDB/VCD波形） | | **协同关系** | 生成仿真结果与调试数据 | 解析仿真结果进行可视化分析 | #### 二、核心功能差异 **VCS核心能力**： 1. 高性能编译仿真 - 支持增量编译技术（如引用[2]所述的高效仿真性能） - 多核并行加速（$T_{sim}=N_{thread}^{-1}*T_{seq}$） 2. 验证流程支持 - UVM/OVM验证方法学集成 - 覆盖率收集（代码/功能/断言覆盖率） 3. 调试基础功能 - 命令行调试接口 - 与Verdi的深度集成（通过$fsdb$波形生成） **Verdi核心能力**： 1. 智能调试技术 - 自动追踪信号传播路径（如引用[1]提到的复杂问题定位） - 事务级调试（Transaction Debugging） 2. 可视化分析 - 波形对比功能（Waveform Compare） - 有限状态机可视化（FSM Viewer） 3. 代码追踪 - 动态代码覆盖率标注 - 跨层级信号追踪（通过nTrace技术） #### 三、典型应用场景 **VCS首选场景**： 1. 大规模设计的功能验证 $$ P_{pass} = \frac{N_{correct\_case}}{N_{total\_case}} \times 100\% $$ 2. 回归测试自动化（结合Makefile如引用[3]所示） 3. 低功耗验证（支持UPF 3.0） **Verdi首选场景**： 1. 复杂波形分析（如总线协议调试） 2. 覆盖率空洞定位（通过覆盖率热力图） 3. 功耗分析（与SPICE仿真数据联动） #### 四、技术指标对比 | **指标** | VCS | Verdi | |----------------|-------------------|-------------------| | 启动时间 | 毫秒级（编译后） | 秒级（加载波形） | | 内存占用 | 与设计规模正相关 | 与波形大小相关 | | 数据精度 | RTL级 | RTL/门级/混合 | #### 五、协同工作流示例 1. VCS编译仿真： ```bash vcs -full64 -debug_acc+all -sverilog design.sv testbench.sv ``` 2. 生成fsdb波形： ```verilog initial begin $fsdbDumpfile("wave.fsdb"); $fsdbDumpvars(0, top); end ``` 3. Verdi加载分析： ```bash verdi -ssf wave.fsdb -nologo ``` [^1]: Synopsys EDA工具（五）--Verdi 介绍 [^2]: 一键部署Synopsys VCS与Verdi [^3]: vcs+verdi Debug记录