84，Verilog-2005标准篇：module端口连接中的real实数表示

最新推荐文章于 2025-04-24 23:28:05 发布
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分类专栏： Verilog-2005标准详解篇 文章标签： fpga开发
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real实数数据类型不能直接连接到模块的端口，verilog提供了一种间接连接方式，如下例所示。 系统函数 $realtobits 和 $bitstoreal 用于在模块端口间传递位模式。

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