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RSS订阅原创 Alllegro PCB如何添加特定封装？
在 "Library" 部分，确保 "padpath" 和 "psmpath" 中包含了封装所在的目录路径。如果没有，点击相应的选项，然后添加封装所在的完整目录路径，点击 "Apply" 或 "OK" 保存设置。（4）在 "Mechanical symbols" 列表中可以看到这个logo的封装。（1）打开 "Place" 菜单，选择 "Manually" 选项，会弹出 "Placement" 对话框。（3）确保 "Library" 选项中勾选了封装所在的库（你之前添加路径的库，并且可访问所在库的封装）。
2025-01-20 17:10:41
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原创 Cadence软件如何修改一般引脚的信号，使得Allegro PCB布局更方便？
回答2疑问：Allegro PCB上先查看一般引脚的编号，然后对照Allegro Design Entry CIS进行最终修改再保存，导出网表，已修改信号后的MCU顺势导入进Allegro PCB，就是新的PCB布局，利于PCB布局。更改前位置，更改后的具体位置）Options：Pin、TOP，查看MCU上方引脚的编号，我们先定下来，右边的DIO_3将移动到这个选定的新编号处-即红色圈出，它编号是U35.29，就是MCU的29引脚。在介绍本篇开始，提出两个疑问：1、为什么要修改一般引脚信号？
2024-12-05 14:40:09
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原创 Cadence Allegro -View/windows介绍以及过孔、盲孔、通孔设置介绍
2.打开规则管理器：Setup-Constraints-physical-All layers（找到Vias 双击这里，添加过孔界面）1.添加封装路径：padpath：焊盘文件路径，psmpath，flash文件路径。3.点击一个盲孔3：4的，右键Edit。回答：1.打开.brd文件。
2024-12-05 13:53:07
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原创 Cadence Allegro PCB怎么解决PP（SMD元件脚与SMD元件脚太近）错误
出现的Show Element说明：SMD Pin to SMD Pin Spacing元件引脚到元件引脚间的距离跟约束值7.5MIL不符合，实际是重叠了。移动反面器件（颜色显示是蓝色），发现不是正面器件（显示红色）和反面器件的问题，有可能是焊盘没有显示的原因，导致我们看不出元件引脚重叠。Design Parameter Editor窗口，勾选Filled pads→Apply→OK。两个反面元件引脚重叠，所以报PP错误，就是这两个元件放置不当，把位置重新放置就可以解决。
2024-12-05 13:52:02
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原创 Candence Allegro PCB如何 修改字体，使得字体大小统一？
Candence Allegro PCB如何 修改字体，使得字体大小统一？
2024-07-16 17:10:55
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原创 Cadence Allegro Entry CIS生成网表问题ERROR
Cadence Allegro Entry CIS生成网表问题ERROR
2024-06-14 17:33:41
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原创 Allegro PCB Design怎么让元器件封装旋转角度？
界面：Find->(All On打开，Symbols勾选)，CN1搜索到元器件封装，再点击移动光标，选中CN1。最最后点击Rotate旋转。
2024-06-07 11:16:56
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原创 【Cadence Allegro PCB Design如何导出封装库 复用现有PCB板上的封装库】
1.Allegro PCB Design已经有画好的PCB（封装无误，且已量产）2.Allegro Design Entry CIS已经有画好的原理图（新手小白，要复用1的封装库）正常步骤是 拿到 2.画好的原理图，DRC规则检查后，生成网络表，再进行后续的封装制作，但是1.已经有画好的PCB，如何进行复用1.导出的封装库呢？
2024-06-06 11:02:02
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原创 STM32F4X寄存器的代码详解—SDA_IN，
资料：STM32F4XX中文参考手册—（7通用IO口/7.4GPIO寄存器）问题描述：我们在STM32F407关于IIC通讯实验例程中发现了一串看不懂的代码，代码所在文价夹是myiic.h ，代码如下所示：可以看到，后边的~(3我们拿#define SDA_IN() { GPIOB->MODER&=~(3MODER|=0如果理解了它，下边的代码同理也能理解。思考过程：看到MODER，知道查看STM32F4XX中文参考手册，看7通用IO口/7.4GPIO寄存器，如
2022-04-21 10:21:44
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空空如也
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