ttl继承逻辑门的逻辑功能与参数测试 实验总结_数电实验(protues)门电路逻辑功能及测试...

本次实验旨在掌握门电路逻辑功能及其测试方法,使用Proteus软件进行仿真,涉及74LS00、74LS20和74LS86等TTL芯片。实验内容包括与非门、异或门的功能测试,并通过电路连接实现逻辑关系验证。在实践中,遇到仿真图元器件连接和背景颜色等问题,通过反复尝试和查阅资料得到解决,加深了对逻辑门电路及Proteus软件的理解。
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实验一 门电路逻辑功能及测试 一、实验目的

1.熟悉门电路的逻辑功能和基本测试方法。

2.学习并掌握Proteus仿真软件的使用方法。

3. 学习并掌握在线实验教学智能考核系统的使用方法。

二、实验设备和器件

1. 在线实验教学智能考核系统、Proteus软件、计算机等。

2. 器件:

(1)74LS00 二输入端四与非门,2片

(2)74LS20 四输入端双与非门,1片

(3)74LS86 二输入端四异或门,1片

3. Proteus仿真库元件:

(1)LOGICPROBE(BIG) //逻辑探头(大)

(2) LOGICSTATE //逻辑状态输入

(3)74LS00,74LS20,74LS86

(4)LED-BLUE,LED-GREEN,LED-RED等

4. 器件引脚图

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三、实验预习要求

1.学习并掌握门电路逻辑功能的基本测试方法。

2.熟悉74LS00、74LS20和74LS三种器件的引线排列、用途和使用方法。

3.学习并掌握万用表和示波器的使用方法。

4.学习并掌握Proteus仿真软件的使用方法。

5. 学习并掌握在线实验教学智能考核系统的使用方法。

四、实验预习问题回答

1.与非门一个输入接连续脉冲,其余端什么状态时允许脉冲通过?什么状态时禁止脉冲通过?

答:与非门接髙电平则其他信号可以通过,接低电平则输出恒为0,与非门的真值表是“有0出1,全1出0”。所以一个输入接时钟,就是用时钟控制与非门,当时钟脉冲为高电平时,允许信号通过,为低电平时关闭与非门。

2.异或门又称可控反相门,为什么?

答:因为当两输入端电平相同时,输出低电平0;当两输入端电平不同时,输出为1;这样就可以保证以上两种情况下,输入端信号可以同时取反相变化,而不改变逻辑门的状态。其输入端的 信号的相位是可以控制的,不影响逻辑门状态

一、实验目的(略)

二、实验设备和器件(略)

三、实验方法与步骤

按照实验要求的电路图连接好仿真电路图,打开屏幕截取器,然后再打开编辑实验报告,生成gif动态仿真截图

四、实验内容和仿真结果

按照实验内容要求在Proteus软件中完成仿真电路的连接和功能测试。

1.测试门电路逻辑功能

用一片74LS00按照图1.1完成的仿真电路图如图1.1-1所示,仿真测试过程GIF图如图 1.1-2所示,测试结果如表1.1所示。

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图1.1-1仿真电路图

表1.1

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2.异或门逻辑功能测试

用一片74LS20按照图1.2完成的仿真电路图如图1.2-1所示,仿真测试过程GIF图如图1.2-2所示,测试结果如表1.2所示。

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图1.2-1仿真电路图

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3.逻辑电路的逻辑关系

(1)用两片74LS00按图1.3和1.4完成的仿真电路图分别如图1.3-1和1.4-1所示,仿真测试过程GIF图分别如图1.3-2和1.4-2所示,测试结果分别如表1.3和表1.4所示。

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图1.3-1仿真电路图

表1.3

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(2)写出上面两个电路逻辑表达式

1.3 Y=A’B+AB’=AB

1.4 Y= A’B+AB’=AB

Z=AB

五、实验总结

1.实验中遇到的问题及解决办法。

问题:

实验1.2仿真图A,B两处发光二极管的链接

实验结果的截取

仿真图背景颜色的改变

仿真图文字编辑时汉字自动转变为?

解决办法:

多试了几次以为是线路连接问题,其实是仿真图元器件遗漏,连接错误的问题

重复看了一遍上次课的回放

百度了一下仿真图背景颜色的改变

目前尚未解决,百度,问同学尚不知晓原因

2.实验的心得体会。

通过这次实验,我了解proteus使用,也学会了如何去制作一个仿真电路图

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