modelsim 仿真clk，rst_n时出现Hiz

最新推荐文章于 2024-10-28 19:28:38 发布
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原文链接：http://www.cnblogs.com/z-l-m/p/8029897.html
本文介绍了一种解决QuartusII联合ModelSim仿真时出现clk、rst_n为Hiz的问题方法，主要原因是Testbench名字与Toplevelmodule名字混淆导致，通过正确配置Testbenchname和Toplevelmoduleintestbench可以解决问题。

摘要生成于 C知道 ，由 DeepSeek-R1 满血版支持， 前往体验 >

1.在使用quartus ii联合modelsim仿真时出现了clk、rst_n为Hiz；

2.在出错的仿真时发现modelsim界面没有i1，正确的应该有，如图 1 所示；

                                                         图 1 

3.我的问题出现在quartus ii调用testbench上，将Top Level Module 的名字写错；

4.找到quartus ii的simulation界面（Assignments--setting--EDA Tool Settings--Simulation）,如图 2；

                                                                                                         图 2 

4.点击Test Benches，在点击New，好，问题的关键来了，注意区别Test bench name与Top level module in test bench的区别，如图 3

 

                                                            图 3

5.Test bench name是你调用的test bench文件的名字（.vt文件），Top level module in test bench为.vt文件中顶层模块的名字。然后再重新编译调用，试试，加油。

 

转载于:https://www.cnblogs.com/z-l-m/p/8029897.html

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