RISC-V

原创 已于 2025-06-09 14:55:57 修改 · 130 阅读 · 0 ·
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于 2025-06-09 14:42:01 首次发布
tql_up
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【RISC-V设计-01】- RISC-V指令集：创新与变革
kearnchen的博客
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介绍RISC-V指令集的起源和发展。
【跟我学RISC-V】（一）认识RISC-V指令集并搭建实验环境
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跟我一起学RISC-V指令集吧
RISC-V简介
坚果的博客
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RISC-­V（发音为“risk­five”）是一个基于精简指令集（RISC）原则的全新开源指令集架构（ISA）。其中的字母“V”包含两层意思，一是这是Berkeley从RISCI开始设计的第五代指令集架构；二是它代表了变化（Variation）和向量（Vectors）。用于嵌入式系统的第五代精简指令集计算技术（RISC-V）技术是指在开发嵌入式应用时使用 RISC-V 开放源码处理器架构。作为一种开放源码架构，RISC-V 允许开发人员修改和优化处理器设计，以满足嵌入式系统的独特要求。
手把手教你玩转RISC-V指令集--第四部分：RISC-V高级应用 4.2 RISC-V高性能计算 RISC-V在高性能计算中的应用
xiaoheshang_123的博客
08-01 990
第四部分：RISC-V高级应用 4.2 RISC-V高性能计算 RISC-V在高性能计算中的应用。
什么是RISC-V？以及RISC-V和ARM、X86的区别
17岁boy的博客
07-27 1万+
RISC-V是基于RISC精简指令集架构开发的一个开放式指令集架构，它是由加州大学伯克利分校的计算机科学教授（克里斯蒂安·阿萨诺维奇）领导的团队开发，RISC-V是开放的，任何人都可以使用它来开发处理器芯片和其他硬件，而无需支付任何许可或使用费用。RISC-V的设计简单，易于扩展和自定义，可以在各种应用场景和市场中使用。指令集架构（，简称ISA）是计算机系统中的一个重要概念，指的是计算机中处理器的指令集和处理器的内部结构，即处理器是如何执行指令的。ISA规定了一套指令集，包括指令的种类、指令的格式。
手把手教你玩转RISC-V指令集--第四部分：RISC-V高级应用 4.2 RISC-V高性能计算 高性能计算的基本概念
xiaoheshang_123的博客
07-27 804
高性能计算旨在通过并行处理技术加速科学与工程计算。HPC系统通常由多个处理器核心组成，它们可以是多核CPU、GPU或其他加速器，通过高速网络互联，以实现大规模并行计算。
【RISC-V设计-07】- RISC-V处理器设计K0A之CSR
kearnchen的博客
08-06 2900
介绍了包含中断处理CSR的RTL实现。
深入浅出RISC-V架构
frostmelody 全网同名，大家多多关注呀~ 持续分享优质内容！
05-18 2184
理解 RISC-V 不仅仅是理解一个技术规范，更是理解一种新的、开放的芯片设计和协作模式。表示该处理器支持64位基础整数指令集、整数乘除法、原子操作、单精度浮点、双精度浮点和压缩指令。RISC-V 是一个近年来备受瞩目、发展迅速的开放指令集架构 (ISA)。这些是可选的、标准化的指令集扩展，用单个字母表示。RISC-V 定义了不同的特权级别，以支持操作系统和系统安全。一个典型的 RISC-V 处理器命名会反映它所支持的指令集，例如。这是 RISC-V 处理器必须实现的核心部分。
手把手教你玩转RISC-V指令集--第三部分：RISC-V编程实践 3.1 RISC-V汇编语言编程 汇编语言的基本语法
xiaoheshang_123的博客
07-27 864
RISC-V汇编语言语法摘要 RISC-V汇编语言是与RISC-V指令集对应的低级语言，具有简洁高效的特点。其基本语法包含：1)指令结构为[标签:]操作码[操作数][;注释]；2)32个通用寄存器(x0-x31)，x0固定为0；3)六种指令格式(R/I/S/B/U/J)；4)伪指令简化编程；5)伪操作控制代码布局；6)宏定义简化重复代码；7)支持行注释(;或#)和块注释(/* */)。掌握这些语法元素是进行RISC-V底层开发的基础，包括寄存器使用、指令格式、伪指令转换等关键内容。
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RISC-V-Reader-Chinese-v2p1.pdf
12-19
RISC-V是一种开源指令集架构（ISA），由加州大学伯克利分校的David Patterson教授和Andrew Waterman教授提出。它代表了简化指令集计算机（Reduced Instruction Set Computer）的第五代，简称为RISC-V。RISC-V指令集...
【RISC-V调试技术】基于JTAG的RISC-V调试模块（DM）与传输模块（DTM）设计：寄存器配置及调试流程详解
04-25
内容概要：本文详细介绍了RISC-V架构下的调试系统，涵盖了调试模块（DM）、调试传输模块（DTM）、调试总线寄存器（Debug Bus Register）及触发模块（TM）的功能与实现。DM作为调试系统的核心，通过JTAG或DMI接口与...
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RISC-V资料集合(RISC-V-Reader-Chinese-v2p1).rar
10-14
在"RISC-V-Reader-Chinese-v2p1.pdf"中，我们可以预期找到关于RISC-V的详细介绍，包括其核心概念、架构原理、指令系统以及相关的软件开发工具链。该文档可能会深入解析RISC-V的基础指令集，如加载/存储指令、算术...
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RISC-V中文手册，汇编指令集手册
04-12
### RISC-V中文手册知识点概览 #### 一、RISC-V简介 RISC-V（精简指令集计算第五版）是一种开源的指令集架构（ISA），它为开发者提供了自由设计处理器内核的能力，同时也支持各种不同的应用领域，如嵌入式系统、...
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RISC-V外部调试支持规范解析与应用 - 版本0.13.2
03-23
内容概要：本文档详细介绍了RISC-V架构的外部调试支持标准（External Debug Support），这是为了在硬件实施阶段提供有效的低级软件和硬件调试支持而建立的标准规范。其主要特点包括全面的支持各种调试特征，如读写...
2025年ChipCamp芯片营地十大开源RISC-V
ChipCamp的博客---https://chipcamp.blog.youkuaiyun.com/
12-30 950
本文介绍了10个开源RISC-V处理器项目，包括XiangShan高性能处理器、UC伯克利的riscv-mini教学项目、芯莱科技的e203_hbirdv2商用SoC等。这些项目均被ChipCamp收录，多数已完成编译测试，部分仍在进行中。其中XiangShan在GitHub获得6.8K星，tinyriscv在国内外平台均有影响力，darkriscv近期更新支持类DOS交互系统。国科大NutShell和ysyxSoC展现了教学成果。这些项目覆盖从教学到商用的多种场景，体现了RISC-V生态的活跃发展。
RISC-V(二)：RV32E(RISC-V 32 位嵌入式精简扩展)
ICer_Designer的博客
12-30 989
RV32E 是 RISC-V 架构对 “极致精简嵌入式场景” 的定制化优化，核心通过裁剪通用寄存器数量实现硬件面积和功耗的降低，同时保持与 RV32I 的指令集兼容，是物联网、超低功耗传感器、微型 MCU 的理想选择。其设计体现了 RISC-V “模块化、可裁剪” 的核心优势 —— 既保留架构统一性，又适配细分场景的极致需求。
RISC-V(一)：RV32I(RISC-V 32 位基础整数指令集)
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RV32I 是 RISC-V 32 位架构的 “最小核心”，通过固定指令格式、正交寄存器设计、精简指令集，实现了 “低硬件复杂度 + 高兼容性” 的平衡。它不仅是所有 32 位 RISC-V 处理器的必备基础，也是理解 RISC-V 模块化设计思想的核心 —— 在此基础上，可通过叠加 M/C/A 等扩展适配不同场景，同时保持指令集的简洁性和可实现性。
基于Python3开发的插件化可扩展网络安全漏洞自动化扫描与检测框架_集成多种常见服务未授权访问漏洞检测如MongoDB_Redis_Memcached_Zookeeper以及高危.zip
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RISC-V软件工具列表：全面审视RISC-V开源生态
RISC-V软件生态系统概述 RISC-V是一种开源指令集架构（ISA），它是基于精简指令集计算机（RISC）原则设计的。这种ISA允许硬件设计者自由地实现指令集，这使得RISC-V成为教学、研究以及商业产品的理想选择。RISC-V的...
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