FPGA状态机——划分诀窍

最新推荐文章于 2025-07-14 14:21:05 发布
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文章标签： fpga开发 信号处理
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在写状态机时化分清楚状态十分重要。总结了一些心得：避免参数重复；状态跳转的顺序逻辑也可以利用。先总结一下，明天在好一些例子和代码。

芯片设计“花招”已耍完？无指令集架构颠覆旧套路
OneFlow深度学习框架
03-26 7815
在面向AI负载的新锐芯片创业企业里，SambaNova和Tenstorrent都足够引人注目，他们都可以视作为数据流架构专门设计的软硬件系统。据公开资料，他们都十分强调编译器软件的重要性，虽然硬件是重配置的，但重配置方案却是编译器完成的，其中最核心的问题是解决placement和routing问题，看上去他们都解决得不错。
FPGA设计技巧
weixin_42905573的博客
04-30 933
FPGA的用处比我们平时想象的用处更广泛，原因在于其中集成的模块种类更多，而不仅仅是原来的简单逻辑单元查找表（LUT）。而且还有一些其他资源，例如：DSP:实际上就是乘加器，FPGA内部...
【长篇肝文7万字】模电/数电/单片机/计算机组成原理/电力电子常见笔试/面试题（合集）未完更新ing
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qq_36045093的博客
08-08 5万+
一、模拟电子电路 1、基尔霍夫定理的内容 基尔霍夫定律包括电流定律和电压定律 电流定律：在集总电路中，任何时刻，对任一节点，所有流出节点的支路电流的代数和恒等于零。 电压定律：在集总电路中，任何时刻，沿任一回路，所有支路电压的代数和恒等于零。 2、描述反馈电路的概念，列举它们的应用。 2.1 反馈的定义： 什么是电子电路中的反馈呢?在电子电路中，将输出量（输出电压或输出电流）的一部分或全部通过—定的电路形式作用到输入回路，用来影响其输入量（放大电路的输入电压或输入电流）的措施称为反馈。 2.2
我的中国“芯”，手把手教你设计CPU
weixin_33918114的博客
04-23 3078
​点击关注异步图书，置顶公众号每天与你分享 IT好书 技术干货 职场知识​​​参与文末话题讨论，每日赠送异步图书。——异步小编永恒的热点——CPU ...
cs231n计算机视觉课程笔记
SereneL9的博客
01-11 1752
P2 目标识别 PASCAL 数据集 一个ImageNet（1500w—4000w、22000类） P3 2012： AlexNet 7-8 层 2014：VGG网络 19层 2015：残差网络152层 1998 LeCun CNN诞生用于数字识别，2012才开始流行的原因：计算能力、标签↑ P4 图像分类-数据驱动方法 计算机眼中的图像：一大堆数字：800*600的像素，每个像素由三个值表示（红、绿、蓝） 问题：语义鸿沟存在于人类定义的语义概念与计算机实际看到的像素值之间。 challenge：
高盛报告：人工智能、机器学习和数据将推动未来生产力的发展
黑白相间...
03-21 1万+
人工智能、机器学习和数据将推动未来生产力的发展 https://blog.youkuaiyun.com/wowotuo/article/details/54744833 人工智能是信息时代的尖端技术。在最新的“创新简介”系列文件中，我们研究机器学习和深度学习的进步如何与更强大的计算和不断扩大的数据库相结合，为跨行业的公司带来人工智能变革。人工智能服务的...
【黑金原创教程】【Modelsim】【第五章】仿真就是人生
weixin_30876945的博客
12-10 1076
声明：本文为黑金动力社区（http://www.heijin.org）原创教程，如需转载请注明出处，谢谢！ 黑金动力社区2013年原创教程连载计划： http://www.cnblogs.com/alinx/p/3362790.html 《FPGA那些事儿—Modelsim仿真技巧》REV5.0 PDF下载地址： http://www.heijin.org/forum.php?mo...
(转)高盛报告：人工智能、机器学习和数据将推动未来生产力的发展
Julia & Rust & Python
01-26 3万+
人工智能、机器学习和数据将推动未来生产力的发展http://note.youdao.com/share/index.html?id=9874d468e9dece80bcc23819232438fd&type=note&from=timeline&isappinstalled=0#/人工智能是信息时代的尖端技术。在最新的“创新简介”系列文件中，我们研究机器学习和深度学习的进步如何与更强大的计算和不断扩
程序员如何管理好自己的思维？
YEYUANGEN的专栏
09-30 2082
摘要：毫无疑问，我们生活在信息丰富的时代。但往往过犹不及，过多的信息却导致了知识和注意力的匮乏。置身于应接不暇的信息中，很容易失去思考的重心。与其游荡在信息的高速公路中 ，不如主动地管理你的思维。 　　—— 摘自图灵教育出版的《程序员的思维修炼》 　　好问题是没有
闲庭信步使用图像验证平台加速FPGA的开发：第十四课——图像二值化的FPGA实现
CHDAJ58的博客
07-14 232
本文介绍了一个基于ModelSim的数字图像二值化处理方案。系统采用全自动化仿真环境，用户只需双击top_tb.bat文件即可完成整个仿真流程。二值化功能通过比较像素值与阈值实现，可灵活设置相位值。工程包含RGB转YCbCr模块和二值化模块，在测试平台中保存并比对图像处理结果。仿真结果显示，软件测试平台与FPGA硬件仿真结果完全一致，且可通过调整相位值获得不同的二值化效果。该方案降低了学习门槛，配套提供200GB学习资料。
【FPGA】AXI总线协议
wuyufei_sun的博客
07-14 852
待补充AXI 协议是一种高性能、高带宽、低延迟的片内总线，具有如下特点：1、 总线的地址/控制和数据通道是分离的；2、 支持不对齐的数据传输；3、支持突发传输， 突发传输过程中只需要首地址；4、 具有分离的读/写数据通道；5、 支持显著传输访问和乱序访问；6、 更加容易进行时序收敛。在数字电路中只能传输二进制数 0 和 1，因此可能需要一组信号才能高效地传输信息， 这一组信号就组成了接口。AXI4 协议支持以下三种类型的接口：1、： 高性能存储映射接口。
如何集成光栅传感器到FPGA+ARM系统中？
最新发布
szxinmai的博客
07-14 485
摘要：光栅传感器集成FPGA+ARM系统方案通过硬件协同与软件优化实现高精度实时测量。硬件层采用差分接收电路、四倍频细分和高速计数器设计，FPGA实现信号数字化与抗干扰算法硬化，ARM层运行实时操作系统与核心控制算法。系统支持多协议解析、EtherCAT同步（误差≤±0.005mm）和5nm分辨率，通过分层架构满足数控机床±1μm定位等严苛需求。关键优化包括PCB电磁兼容设计、动态功耗管理和宽温可靠性验证，典型问题采用光电隔离、迟滞比较器等方案解决。（150字）
基于光栅传感器+FPGA+ARM的测量控制解决方案
szxinmai的博客
07-14 625
本文提出一种基于光栅传感与FPGA+ARM异构架构的高精度测量控制系统。系统采用分层设计：光栅传感器实现微米级位移检测，FPGA负责实时信号处理（四倍频细分、多通道并行处理），ARM执行复杂算法和外围管理。关键创新包括动态跟踪细分（分辨率达5nm）、多轴同步控制（±1μm精度）及抗干扰设计。该系统支持EtherCAT总线扩展，适用于数控机床、半导体检测等场景，具备微秒级响应、纳米级分辨率和恶劣环境适应性，为工业自动化提供可靠测量解决方案。
XCZU47DR-2FFVG1517I Xilinx FPGA AMD ZynqUltraScale+ RFSoC
2403_90082736的博客
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XCZU47DR-2FFVG1517I 是 Xilinx（现 AMD）推出的 Zynq UltraScale+ RFSoC Gen3 系列中的中高端型号。该器件将高采样率射频模数转换器（RF-ADC）、数模转换器（RF-DAC）、ARM 多核处理系统（PS）、高度可编程逻辑区（PL）、专用 FEC 解码器（SD-FEC）以及高速收发器（GTY）集成于单颗芯片之内，形成一个面向无线通信、相控阵雷达和软件定义无线电的片上信号处理系统。
【FPGA】高速接口PCIe
wuyufei_sun的博客
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单端并行信号（PCI总线）高速差分信号（PCIe总线）：更高的时钟频率，使用更少的信号线，完成之前需要许多单端并行数据信号才能到达的总线宽度PCI总线使用并行总线结构，在同一条总线上的所有设备共享带宽，而PCIe总线使用了高速差分总线，采用端到端的连接方式（每一条PCIe链路中只能连接两个设备）PCIe总线除了在连接方式上与PCI总线不同之外，还使用了一些在网络通信中使用的技术，如支持多种数据路由方式，基于多通路的数据传递方式，和基于报文的数据传送方式，并充分考虑了在数据传送中出现服务质量的问题。
以太网基础⑤UDP 协议原理与 FPGA 实现
hhh123987_的博客
07-10 964
UDP收发框图（不含代码）
闲庭信步使用图像验证平台加速FPGA的开发：第十五课——基于sobel算子边缘检测的FPGA实现
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07-14 214
本系列教程使用ModelSim实现基于Sobel算子的边缘检测，提供全自动化仿真环境（双击top_tb.bat即可运行）。教程重点介绍了：1）利用已实现的data_cache模块简化Sobel算子实现；2）采用绝对值求和代替复杂运算；3）通过polarity参数控制边缘黑白显示。工程包含RGB转灰度、边缘检测模块，并通过比对软件仿真与FPGA处理结果验证正确性（结果图片保存在img文件夹）。配套资源可通过知识星球获取，包含200GB学习资料。该方案大幅降低了图像处理的学习门槛，特别适合FPGA初学者。
LVDS系列20：Xilinx 7系ISERDESE2原语（一）
weixin_38828382的博客
07-10 886
1bit，组合输出，该端口为组件未经过寄存器的输出，可以直接来自输入D端口或DDLY端口，从组件的框图可以看出O端口的产生结构，来自一个由OFB、DDLY、D端口输入的IOB多路复用器的输出，没有经过ISERDESE2的组件；可以看到，OSERDESE2输出端位序与ISERDESE2输入端的位序相反，OSERDESE2输入一个D1~D8，对应ABCDEFGH的数据，输出时，按D1到D8，也就是A到H的并行数据种低位先发的顺序发送数据，1bit，高电平有效时执行位滑动操作，与CLKDIV同步；
【FPGA】LUT如何实现组合逻辑、时序逻辑
wuyufei_sun的博客
07-12 819
当 A=1, B=0：LUT1 地址={B,A}=01=1，输出位1=1（4'h6=0110，位1=1）；第1个查找表输入的地址为1，第2个查找表输入的地址为2，因此第1个查找表输出4'h6（3'b110）第1位1，第二个查找表输出'h8（3'b1000）第2位0，因此Q的值为2'b01 = 1；第1个查找表输入的地址为2，第2个查找表输入的地址为1，因此第1个查找表输出4'h6（3'b110）第2位1，第二个查找表输出'h8（3'b1000）第1位0，因此Q的值为2'b01 = 1；
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