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1.1 EDK及SDK部分术语EDK：Embedded Processor Development Kit，嵌入式处理器开发包。XPS：Xilinx Platform Studio，平台工作室。用于嵌入式处理器硬件部分的开发。SDK：Software Development Kit，软件开发套件。基于Eclipse平台，支持C/C++。MicroBlaze总线：MB实质上是一个IP

Clock Generator模块：端口说明：CLKIN为外部输入时钟，如果是外部差分时钟信号，在MHS文件的PORT行指定*_p、*_n管脚均为同样的Net，如dcm_clk_s，差分极性分别指定正负即可。CLKFBIN为DCM的CLKFB输入端口，如果选择使用，即DCM使用外部反馈方式，此时CLKFBOUT输出口也应该使用，且CLKFBOUT连接到CLK0输出口，而CLKFBIN连

XPS intc中断处理模块：端口说明：模块作为一个32位宽的PLB从设备连接到PLB总线上。模块内部有8个寄存器，因此PLB地址空间最少为32，大的地址空间可减少译码逻辑，提高系统性能。寄存器均32位宽，只能使用字访问方式，具体地址参见手册P10。单个模块提供最多32个中断源输入，通过多个IP模块级联，允许更多的中断输入。 中断请求输入端口Intr[(C_NUM_INTR_I

端口说明：RX、TX为收发端口，Interrupt为中断输出端口，如果通过设置CTRL_REG寄存器相应位使能中断，当接收FIFO收到有效数据或发送FIFO从非空变空，即最后一个数据发送出去时，中断产生。C_SPLB_CLK_FREQ_HZ为PLB总线时钟，根据此时钟选取可使用的波特率。例如总线时钟为10MHz，如果选取波特率115200，那么串口采样时钟应该为16*115200=1.84

端口说明：外部IO信号连接到GPIO_IO上即可，其余端口无需连接。参数说明：C_BASEADDR和C_HIGHADDR必须覆盖模块所需要的地址空间，最小空间为0XFF，如果使用中断，即C_INTERRUPT_PRESENT被设置，则地址空间最小为0x1FF。C_IS_DUAL被设置，则使能通道2。C_DOUT_DEFAULT为系统复位后C_TRI_DEFAULT为系统复位后GPIO_TRI寄