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RSS订阅原创 Xilinx FPGA嵌入式开发（五）- XPS中的Uart(Lite)模块
端口说明：RX、TX为收发端口，Interrupt为中断输出端口，如果通过设置CTRL_REG寄存器相应位使能中断，当接收FIFO收到有效数据或发送FIFO从非空变空，即最后一个数据发送出去时，中断产生。C_SPLB_CLK_FREQ_HZ为PLB总线时钟，根据此时钟选取可使用的波特率。例如总线时钟为10MHz，如果选取波特率115200，那么串口采样时钟应该为16*115200=1.84
2012-06-13 15:07:03
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原创 GNU make和Makefile-使用中的一些要点总结
本文参考了一些网上资料，特别是《跟我一起写 Makefile》一文。命令make运行时，会在当前目录下找名字叫“Makefile”或“makefile”的文件。如果找到，它会找文件中的第一个目标文件（target），并把这个文件作为最终的目标文件，然后递归分析此目标文件的依赖目标，根据时间戳信息，决定哪些文件需要重新编译，最后得到最终的目标文件。运行make时，可跟参数，例如make –C /
2012-06-13 15:01:52
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原创 ADuC845设计总结-通用IO端口
P0、P2、P3口为双向端口，每个位具有一个端口锁存器，用做输入输出锁存。P2、P3具有内部上拉电阻，其中P0口为开漏极IO，无上拉电阻，需要外部硬件提供。向P0、P2、P3端口的一个引脚写1时，数据首先被载入端口引脚的锁存器中，锁存器驱动一个连接到端口引脚的场效应管。上电复位后所有端口锁存器被置1，即对相应位写1（此时可做为输入）。P0、P2、P3口为低时灌电流1.6mA，为高时驱动电流仅20u
2012-06-13 14:47:25
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原创 基于WG2005的PCB设计-DEVICE值和symbol、Cell
1) 创建symbol时，其DEVICE属性值必须为大写。如果含小写字母，多个相同的symbol放置到原理图中Create Netlists会出错（Duplicate Attribute error）。2) 原理图中，不同DEVICE属性值的两个器件，symbol可以相同，CELL也可以相同。例如DEVICE值分别为CAP0805、CAP0603的两个电容，其Symbol都是库ca
2012-06-13 14:40:23
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原创 Xilinx FPGA嵌入式开发（四）- XPS General Purpose IO模块
端口说明：外部IO信号连接到GPIO_IO上即可，其余端口无需连接。参数说明：C_BASEADDR和C_HIGHADDR必须覆盖模块所需要的地址空间，最小空间为0XFF，如果使用中断，即C_INTERRUPT_PRESENT被设置，则地址空间最小为0x1FF。C_IS_DUAL被设置，则使能通道2。C_DOUT_DEFAULT为系统复位后C_TRI_DEFAULT为系统复位后GPIO_TRI寄
2012-06-13 14:34:39
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原创 Xilinx FPGA嵌入式开发（三） - XPS中的中断处理模块
XPS intc中断处理模块：端口说明：模块作为一个32位宽的PLB从设备连接到PLB总线上。模块内部有8个寄存器，因此PLB地址空间最少为32，大的地址空间可减少译码逻辑，提高系统性能。寄存器均32位宽，只能使用字访问方式，具体地址参见手册P10。单个模块提供最多32个中断源输入，通过多个IP模块级联，允许更多的中断输入。 中断请求输入端口Intr[(C_NUM_INTR_I
2012-04-14 18:55:46
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原创 基于WG2005的PCB设计-DxDesigner使用指南（二）
关于builtin下面的gnd和pwr符号Ø 怎样使用：gnd、pwr等符号是一个单Pin类型的符号，虽然是个symbol，但是没有封装对应，只有一个Pin，查看对应的Symbol中管脚属性即可明白。实际使用时，把gnd、pwr放置在原理图中，然后把Component属性->Attributes中NETNAME更改为所需要的网络标号即可。一般gnd符号的NETNAME为GND，
2012-04-14 18:46:52
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原创 Xilinx FPGA嵌入式开发（二） - XPS中的时钟模块和复位模块
Clock Generator模块：端口说明：CLKIN为外部输入时钟，如果是外部差分时钟信号，在MHS文件的PORT行指定*_p、*_n管脚均为同样的Net，如dcm_clk_s，差分极性分别指定正负即可。CLKFBIN为DCM的CLKFB输入端口，如果选择使用，即DCM使用外部反馈方式，此时CLKFBOUT输出口也应该使用，且CLKFBOUT连接到CLK0输出口，而CLKFBIN连
2012-04-14 18:39:42
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原创 运算放大器常用术语和规格参数
1) 输入失调电压（VOS）：即输入Offset Voltage，该参数表示使输出电压为零时需要在输入端作用的电压差。即定义为集成运放输出端电压为零时，两个输入端之间所加的补偿电压。输入失调电压实际上反映了运放内部的电路对称性，对称性越好，输入失调电压越小。输入失调电压是运放的一个十分重要的指标，特别是精密运放或是用于直流放大时。输入失调电压与制造工艺有一定关系，其中双极型工艺的
2012-04-08 20:29:13
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原创 ARM指令 LDR、LDR伪指令、MOV的区别
ARM体系中，数据从内存到CPU寄存器之间移动只能使用LDR/STR（此处LDR不是伪指令），MOV只用于寄存器之间移动数据或者把有限制的立即数赋给寄存器。例如下面的语句： COUNT EQU 0x40003100 LDR R1,=COUNT MOV R0,#0 STR R0,[R1]COUNT是定义的变量；LDR源操作数前有=号则为伪指令，含义是把CO
2012-03-12 19:02:50
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原创 Ubuntu中NFS服务及网络文件挂载
NFS(Network File System, 网络文件系统)可以通过网络将分享不同主机(不同的OS)的目录，即可以通过NFS挂载远程主机的目录, 访问该目录就像访问本地目录一样。，启动网络文件系统NFS服务。1) NFS安装：apt-get install nfs-kernel-servernfs-common portmap。在Ubuntun中使用aptitude install nf
2012-03-12 18:58:29
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原创 ADuC845设计总结（一）
1.1 存储器结构内部数据存储器地址范围00H-FFH，256B大小，其中低半部分用于存放通用数据，即内部RAM，高半部分为特殊功能寄存器SFR，地址80H-FFH。内部RAM又分割成通用寄存器组（共4组，每组8个字节共32字节，00H-1FH）、可位寻址RAM（16字节，20H-2FH）、通用RAM（30H-7FH共80字节）。注：复位后堆栈指针位于07H，压栈时指针先加1，即从08H寄
2012-03-12 18:54:17
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原创 Xilinx FPGA嵌入式开发（一） - EDK及SDK部分术语
1.1 EDK及SDK部分术语EDK：Embedded Processor Development Kit，嵌入式处理器开发包。XPS：Xilinx Platform Studio，平台工作室。用于嵌入式处理器硬件部分的开发。SDK：Software Development Kit，软件开发套件。基于Eclipse平台，支持C/C++。MicroBlaze总线：MB实质上是一个IP
2012-03-12 18:48:28
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原创 基于WG2005的PCB设计-DxDesigner使用指南（一）
1 DxDesigner篇1.1 新建或打开一个项目Ø Dashboard环境下，在“Projects”点右键，打开或新建一个项目。打开或新建项目后，首先加入所需要的库，如果项目已经存在一些库，确认库的路径正确，如果路径错误，会在库名上出现红X，重新指定正确的路径即可。Ø Dashboard环境设置完毕后，点击DxDesigner，进入DxDesigner环境，下面操作均指在D
2012-03-12 18:45:52
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原创 指针与数组-相似与区别
为了深入分析指针和数组的之间的相似点和不同点，查询了一些资料，本着行胜于言的原则，以两个具体的例子在VS2008环境中进行实际编程验证，终于彻底弄清楚了。例子1，如果一个文件file1.c中定义了一个全局数组char Array[2]={1,2}，则Array是一个代表数组的首地址的标号（Label），此处假设为0x5000。在程序中所有使用Array的地方，用数组首地址来替换，例如Array
2012-03-07 22:23:39
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空空如也
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