Cadence
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ic设计学习者
这个作者很懒，什么都没留下…
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Cadence公司的数字IC设计工具：时序分析（Tempus）
Tempus能够为基于cell的设计执行快速精确的信号完整性感知延迟计算(signal integrity-aware delay calculations)。该软件将信号完整性(signal integrity, SI)分析与时序分析相结合，以检查由于SI故障导致的功能故障，并执行精确的时序计算(考虑SI和IR-drop影响)。在传统的延迟计算器中，使用单个线性slew值作为分析级的输入。先进的技术（28nm及以下）需要基于波形的延迟计算器来基于波形精确地计算延迟。原创 2024-10-30 09:28:15 · 1564 阅读 · 0 评论 -
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