Altium Designer20 PCB板子绘制

已于 2022-01-28 21:56:59 修改
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分类专栏： MCU 文章标签： AD
于 2021-04-07 13:54:23 首次发布
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本篇博客详细介绍了如何使用Altium Designer20进行PCB板子的设计，包括设置版层、调整板子大小、布局、过孔连接、线宽设定、安全距离、元器件旋转、光标大小、RoutingLayers配置、过孔大小、顶层到底层镜像、线路检查、自动走线、泪滴保护和敷铜等关键步骤。

摘要生成于 C知道 ，由 DeepSeek-R1 满血版支持， 前往体验 >

版层

top layer 顶层
bottom layer 底层

设置板子大小

在这里插入图片描述

布局

过孔

top layer层连到bottom layer层。通过via连接。
在这里插入图片描述

设置线宽

在design rules里可以设置线宽。
在这里插入图片描述
在这里插入图片描述
右键new rule

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用Altium Designer绘制PCB图
qq_44719839的博客
12-28 945
一、原理图封装 二、PCB图绘制 （一）布局 （二）设置规则 （三）自动布线 （四）覆铜 （五）丝印整理 （六）电器规则检查 三、添加logo 四、生成GerBer光绘文件 一、原理图封装 1、打开上次绘制的STM32最小系统原理 我打开的是新画的原理图，怕原来画的不对。跟着B站视频画的，新画的长这样。 在这里插入图片描述 2、添加新的PCB工程 在这里插入图片描述 3、保存（自行选择保存位置） 在这里插入图片描述 不保存的话后续没办法把原理图导入PCB。 4、编译 对原理图进行编译，检查错误 在这里插入图
Altium Designer设计PCB常用快捷键
02-10
Altium Designer是电子设计自动化软件，广泛用于印刷电路板（PCB）设计。掌握其快捷键对于提高设计效率具有重要意义。以下是Altium Designer设计PCB时常用的一些快捷键： 1. 视图操作： - 鼠标右键或按住滚轮平移...
AD20-net antenna：via
m0_70313675的博客
08-13 4366
前几天画pcb的时候，出现这个错误，开始百思不得其解，后面搞明白了 绘制PCB的时候，出现了“net antenna：via……”的错误原因： 1、规则里面设置错误 2、过孔上的这根线没有连接上了网络 3、不需要过孔的铺铜放了过孔。 我当时错误原因： 我的铺铜在顶层 ，但这个铺铜的网络并没有穿层，仅出现在在顶层，所以解决方法是：把这些不必要的过孔删掉。 ...
【AD DRC错误】Short-Circuit Constraint: Between Polygon Region (52 hole(s)) Top Layer And Via fro
weixin_43322056的博客
02-18 1万+
出现报错：Short-Circuit Constraint: Between Polygon Region (52 hole(s)) Top Layer And Via from Top Layer to Bottom Layer Location : [X = 0mil][Y = 0mil] 铺铜的Clearance中 Via 和Copper的间距之前设为0了，可能会出现以下问题 DRC 修改后，铺铜 正常，DRC正常 ...
Altium Designer 20基础入门教程第1章：AD20核心功能与操作
最新发布
weixin_28922227的博客
05-25 1011
用户可以自定义界面布局来提高工作效率。Altium Designer 20提供了广泛的界面定制选项，例如工具栏的拖放，自定义面板和快捷键的设置。自定义操作简单，只需要拖动或选择相应的设置即可。Altium Designer中的项目可以包含多种类型的文档，每个文档类型在设计流程中扮演着不同的角色。以下是一些主要的文档类型：原理图文档：用于捕获电路的逻辑布局，提供给PCB设计阶段使用。PCB文档：包含了实际的PCB布局和布线信息，这是制作实际电路板的蓝本。仿真文档。
自动布线出现的两个错误
quinn1994的博客
03-06 4685
1、[Minimum Solder Mask Sliver Constraint Violation] exoskeleton.PcbDoc Advanced PCB Minimum Solder Mask Sliver Constraint: (0.182mm < 0.254mm) Between Via (102.413mm,113.182mm) Top Layer t...
Altium Designer中关于层、名词的理解笔记
qq_42547241的博客
05-25 1833
转载出处： http://blog.sina.com.cn/s/blog_15183f5750102vvwe.html https://blog.csdn.net/RObot_123/article/details/103248591?utm_medium=distribute.pc_relevant.none-task-blog-baidujs-2 PCB焊盘： 元件通过PCB上的引线孔，用焊锡焊接固定在PCB上，印制导线把焊盘连接起来，实现元件在...
ad18报错：net antennae:track
创世纪GENESIS
07-02 6458
net antennae的含义是网络天线，这里可以理解为板卡上某个网络的布线形成了天线，但是没有特别标注这一部分是天线，于是系统判定是设计失误。画了板子之后发现有这个错误提示，看了图，发现是在一个焊盘下面有2根残留的线，而且线边上出现了天线标志。这个规则的是指某些网络如果走线走到一半，并且走线长度超过设定值，而没有另一头接应，就形成天线效应。某网络存在单头的接线（形如天线，一端不与任何电气部分连接），又没有将其设置为天线属性，所以报错。（需要放大仔细检查导线哪里没有连接上，没有连接上的地方有天线的标志）
Protel中PCB检查各种报错
frontend的专栏
07-31 1431
clearance constraint 引脚安全间距问题
AltiumDesigner PCB绘制流程整理
08-05
以下是关于"Altium Designer PCB绘制流程"的详细说明： 1. **原理图绘制**：首先，设计师需要使用Altium Designer进行原理图设计。在这个阶段，你需要规划电路的基本结构，包括电源、信号线和元器件的连接。利用...
Altium_designer_PCB训练手册.zip_Altium Designer_altium_pcb
09-20
Altium Designer是一款强大的PCB（印制电路板）设计软件，广泛应用于电子设计领域，尤其适合初学者和专业工程师进行电路板布局与布线。本训练手册是专门为想要掌握Altium Designer的用户准备的，提供了详尽的学习...
AD19 报错记录 Un-Routed Net Constraint: Net LED Between Pad J3-10
qq_31764341的博客
10-15 5930
AD报错： Un-Routed Net Constraint: Net LED Between Pad J3-10(1493.055mil,1510.079mil) on Multi-Layer [Unplate 当然我的线是连着的 就一直报错没有连接 而且是它自己和它自己没有 连接 然后网上查 说是封装顶底两层的焊盘没有电镀 就会出这个warning 可以选择不电镀 那么上下焊盘没有电连接 如果要电镀 那么找到这个封装 点这个焊盘-Properties-Hole information-Plated 把p
关于Altium designer中各个层的讲解
weixin_44557075的博客
07-21 3万+
一、常用层讲解 1、Top layer（顶层），用于顶层布线等，这个大家比较熟知，不做过多介绍。 2、Bottom layer（底层），用于底层布线。 3、Top overlay（顶层丝印层），黄色部分就是丝印层，如元器件编号和元器件框等。 4、Bottom overlay（底层丝印层），与顶层丝印类似，只不过此部分是用在Bottom 层 5、keepout layer（禁止布线层），定义电气特性的布线边界，此边界外的区域是不能进行布线与具有电气意义的，见下图粉色部分；由于该层与mechanical层
AD的“Un-Routerd Net Constraint:......”报错处理
m1109609874的博客
09-30 5万+
最近在画一个板子的时候，DRC检查出现一个报错：Un-Routerd Net Constraint:...... 当时就上百度找了一下，有说是焊盘属性里的“镀金”没有勾选，我核对了一下，发现我的焊盘没有问题；于是各种尝试，排除。  这是报错的具体位置：     最后，我把这个报错位置的电阻R9拖到外面去，然后再执行DRC，不难发现，还是有这个报错，因此可以
【AD23报错】Net Antennae (Tolerance=0mil) (All) 的解决方案
weixin_50499137的博客
12-03 1万+
【AD23报错】Net Antennae (Tolerance=0mil) (All) 的解决方案 使用AD（Altium Designer）画PCB，画完之后，进行DRC检测时报以下错误： Net Antennae: Track (2240mil,2740mil)(2240mil,2770mil) on Bottom Layer 这种问题一报错通常情况下是有未连接到端的引线，即某网络存在单头的接线（形如天线，一端不与任何电气部分连接），又没有将其设置为天线属性，所以报错会产生天线效应，对其他元器件进行干扰
使用AD（Altium Designer）画PCB报错Net Antennae: Track....的解决方案
mzw72188552的专栏
03-20 5万+
使用AD（Altium Designer）画PCB，画完之后，进行DRC检测时报以下错误： Net Antennae (Tolerance=0mil) (All) Net Antennae: Track (4766.404mil,4567.236mil)(4953.804mil,4567.236mil) on Top Layer 这种问题一般是因为，有类似天线的布线： ...
原理图与 PCB 绘制备忘
朱工的专栏
11-17 3201
原理图与 PCB 绘制备忘。
AD20/Altium designer——如何对线宽进行设置、布线过程中快速改线宽的方法
热门推荐
嵌入式创客工坊的博客
02-24 5万+
1.设计→规则 2.线宽设置 首选宽度即 布线时的 默认线宽 3.布线过程中改线宽 连线过程中按 Tab键 打开布线属性，直接 输入线宽 后 回车键 即可
Altium Designer教程：绘制PCB的四大步骤详解
本文档详细介绍了如何使用Altium Designer（AD）进行PCB（Printed Circuit Board，印制电路板）的设计流程，特别是针对PCB_radio电路为例，阐述了设计的关键步骤。以下是主要内容概要： 1. PCB概述： PCB是电子...
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