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原创 焊盘设计5之创建椭圆形Flash焊盘

针对槽型孔,创建异性的热风焊盘。

2024-12-09 17:36:18 1201

原创 如何使用一个快捷键控制两个命令-skill版本

通过skill命令用一个快捷键控制多个命令

2024-11-20 15:06:01 296

原创 allegro16.6 封装建立使用说明书

allegro16.6版本焊盘封装建立说明文档。按照步骤一步一步,肯定能学会如何建立一个封装。

2024-08-15 15:48:50 2272

原创 焊盘设计4之创建Flash焊盘

1.创建flash文件的方法,2.按照规范建立flash3.allegro22.1版本无法显示flash问题的解决办法。

2024-05-24 23:57:09 1645

原创 焊盘设计3之shape symbol创建异形焊盘

异形焊盘主要是得到需要通过软件去创建一个的shape symble 异形的器件。然后在之前我们创建表贴焊盘的位置,不用选择什么圆形还是矩形,输入长宽数据,而是直接通过shape symbol一栏,选择自己刚刚建立好的shape symbol即可。

2024-05-19 21:58:22 1844

原创 焊盘设计2之通孔焊盘设计

22.1版本建立的通孔焊盘,也适合17.2以后的版本,算是很简单的软件使用流程教学吧。

2024-05-17 23:39:55 1873 2

原创 焊盘设计1之表贴焊盘设计(Allegro22.1)

表贴焊盘设计。适用于17.2及以后的allegro版本。

2024-05-17 22:43:14 1283

原创 利用SI9000 仿真走线损耗

使用SI9000 可以非常简单的计算出一段走线长度的损耗,当然这是不包含过孔,连接器的,无法准确给出整个链路的损耗。但是可以里用这样简单的计算,在设计前做一下走线长度的评估。

2024-01-13 21:30:26 2745 4

原创 SI9000差分阻抗计算方式

差分线阻抗计算。第一次接触计算阻抗线时,总会问这么个线宽,线间距对不对,为什么这么填?信号看的是衰减,阻抗看的是匹配,还有你自己评估走线难度大不大。也就是说,你走线很顺,过孔之间能穿线,阻抗是计算对了,管它计算出来的阻抗线是10mil还是4mil。唯一要看的就是高速信号线细了,那么相同长度的衰减可能会更大。所以建议高速信号,有条件就走稍微宽一点吧。松耦合还是紧耦合?

2023-12-15 22:35:28 1299

原创 SI9000阻抗计算

si9000阻抗计算,微带线和带状线。微带线有阻焊的单端50ohm阻抗计算法

2023-12-15 21:59:58 4401 2

原创 SIwave中带有电路元件的网络设计操作

SIwave拓展网络Xnet添加办法在某些高速串行信号中,需要在网络中串入无缘器件(R、L、C),仿真中需要直接对整个链路进行仿真,包括链路中点电阻,电容或者电感。

2023-12-01 22:36:46 1706 4

原创 Failed to run the IDA analysis 报错解决方法

Failed to run the IDA analysis because the Trace Editor executable could not be found.

2023-10-06 21:19:37 1148 9

原创 SIwave串扰分析

通过颜色分析,没有耦合太严,串扰量都很小,满足阈值。1.右键可以选择查看结果,远端串扰还是近端串扰。3.也可以右键使用警告和违规的显示方法查看结果。如何导入allegro文件,可以参考。设置完成之后,点击launch(运行)帮忙翻译了一下,参考。2.红色表示串扰量比较大。

2023-09-17 19:36:09 1066 3

原创 SIwave的TDR仿真

TDR仿真,查看传输线延时。

2023-09-09 16:40:05 2387

原创 SIwave电源阻抗(PDN)分析。

Z阻抗只看PDN的时候,只需要关注自阻抗就好了。名字一样的是自阻抗,VRM到后面是传输阻抗,

2023-08-03 19:42:36 3635 8

原创 allegro文件导入到SIWAVE,仿真阻抗线

Custom (selecting this option allows you to configure advanced solver setting)此选项可以配置高级仿真模式设置,勾选之后,后面SI/PI advance 里面的选项灰色会更改为可设置模式。可以在下方的参数栏里面,选择材料类型,然后 update ,可以对相同类型的材料进行统一修改。在菜单栏里面,选择simulation,使用impedance scan 进行分析设计。

2023-05-28 22:23:20 2703 1

原创 Ansys导入brd文件有个错

然后就可以看到你板子上面的信息了,包括很多的信号以及位号器件。其他看不明白,也没有设置,打开就是设置一下文件的范围器件图形形状,分析频率。百度说,这里是由于allegro17.2版本的extracta.exe.文件的路径不对,你的安装路径上面找到然后在编辑环境变量,就可以了。然后在弹出的菜单栏中,选择import 就有一个allegro文件的选择,找到你需要的文件,打开。在系统变量中,找到path路径,然后编辑,新建一个路径指向17.2版本的库文件里面。然后就可以了,如下图,真的,B格太高了。

2023-04-20 22:06:13 2019 4

原创 Model Integrity 分析工具

此工具可以让我们在编辑环境中快捷的新建、操作、验证模型。其主要还是用来验证模型的正确性。内部提供语法检查器,标志导航功能提供修改模型语法分析的简易方法。

2023-04-16 00:18:09 924 1

OrCAD Capture-CIS建库详细步骤解析

内容概要:本文详细介绍了基于Access2016库文件和Allegro17.2版本创建Capture-CIS库的具体步骤。涵盖从新建数据库表,字段设置,数据源管理,以及Capture CIS配置和Capture.ini文件的修改,确保各组件之间的联动性和一致性。最后展示了如何验证配置的正确性。 适合人群:OrCAD和Cadence工具用户,尤其是那些希望进行高效电路设计的工程师和技术人员。 使用场景及目标:帮助读者掌握如何搭建并配置高效的Capture-CIS库,提升电子设计自动化(EDA)项目的开发效率和质量。 其他说明:文中提供了一系列具体的操作步骤和技巧,建议边读边实践以加深理解。同时需要注意不同版本软件间可能存在细微差异。

2024-12-13

更新-Allegro 17.2背钻孔设置及优化处理

内容概要:本文详细介绍了在Allegro 17.2软件中如何设置背钻孔(Backdrill),包括如何确定需要背钻的网络、如何给网络添加背钻属性、如何设置背钻种类及其相关参数。此外,文章还讨论了一些常见的背钻设置问题和解决方案,如设置错误的识别和修正。最后,文章提到了一些高级设置,如强制背钻和排除特定过孔或引脚进行背钻的方法。 适合人群:具备一定Allegro使用基础的PCB设计工程师。 使用场景及目标:本文帮助PCB设计师在高速信号传输中减少不必要的寄生电容和电感效应,提高信号完整性和产品质量。通过设置背钻孔,可以在多层板中有效地去除不必要的过孔Stub,确保高速信号的稳定传输。 阅读建议:读者应先熟悉Allegro的基本操作,在理解本文内容的基础上,逐步尝试进行背钻设置。特别需要注意的是,背钻设置需要仔细规划,避免因设置不当导致的问题。建议在实践中不断调整参数,逐步优化设计方案。

2024-12-13

用skill解决一个快捷键控制多个命令的办法-源码

使用skill注册两个命令,函数分别指向启动使用copy和move命令。启动使用的时候顺便使用axlsetfunckey 设置快捷键。这样每次运行都会刷新一次快捷键(需要使用新命令启动原命令,才会刷新。) 我发现这个操作思路可实现一个快捷键控制很多命令,源码很简单,我分享给大家,随便修改。

2024-11-20

allegro16.6 封装建立位号文字信息文件

建立封装时候,直接import--> sub drawing文件,就可以把文章中提到得位号信息直接添加到封装设计中去。

2024-08-15

PCB设计封装设计及命名规范

1.这里包含了各种封装焊盘设计规范,管脚补偿计算方式 2.各种常见常用封装命名规范达60余中 3.allegro封装设计应包含的信息 4.对于初次建立封装的小伙伴非常非常有用。

2023-12-15

allegro 17.2背钻设置

17.2背钻设置参数详细描述以及背钻操作办法。 注:正常情况下,背钻一定会残余,大约8mil左右,即使选择例1,也不会钻到第四层。但是如果H比较大,例2也意味着,可能导致背钻剩余的残桩会更大。

2023-11-20

LPC2138流水灯

基于keil5编写的LPC2138的流水灯程序,以及仿真文件。

2017-07-14

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