小梅哥二选一多路器

sky七弦月光

于 2021-11-30 22:18:11 发布

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文章标签： fpga开发

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本文介绍了如何使用Verilog语言设计和实现一个二选一多路器，通过两种不同的代码写法展示了其工作原理。第一种是结构化文本，第二种是直接赋值语句。详细解析了两个代码版本，并提供了它们的RTL视图。适合学习数字电路设计的学生和工程师参考。

摘要生成于 C知道，由 DeepSeek-R1 满血版支持，前往体验 >

二选一多路器为数字电路中讲过，如果SEL＝１，ｏｕｔ＝ａ；如果SEL＝０，ｏｕｔ＝ｂ；

真值表达式如下：

SEL	ｏｕｔ
１	ａ
０	ｂ

用ｖｅｒｉｌｏｇ语言有两种写法：

module mux2(
    input SEL,
    input a,
    input b,
    output reg out
    );
    always @ (*) 
    if(SEL)
        out = a;
    else 
        out = b;
endmodule

RTL视图如下

第二种仿真代码写法如下

module mux2(
    input SEL,
    input a,
    input b,
    output out
    );
    assign out=(SEL==1)?a:b;
endmodule

RTL视图如下：