快速上下电对系统可靠性设计的意义

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前言

电路设计中，满足MCU的上电时序，是系统设计最基本最重要的要求之一，因此设计中我们会格外关注系统电源的上下电时间，如果上下电时间过长，可能会导致MCU启动失败或系统运行逻辑混乱，因此缩短MCU电源的上电和放电时间就显得尤为重要。

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一、如何加快系统上电时间？

以LDO或Buck类电源为例，之前项目中遇到一个问题，因为使能引脚EN输入电压范围跟输入引脚VIN一样，因此设计时直接将使能引脚接电源，后面板子回来做硬件测试时发现电源上电期间有抖动现象，且上电时间比较长。后来通过分压电阻将使能引脚用起来，上电抖动消失，并且上电时间明显减小。

那么，为什么会有这种情况？

原因：使能引脚通过外部上拉来默认使能，会过早地让电源芯片达到使能阈值，输出就会跟随输入，即输入有多慢输出就有多慢，且上电时输入端的抖动也会传送给输出，并且这种接法在输入电压不高的情况下打开芯片可能会导致芯片输出又跌落的情况发生。如下图所示为设置EN直接上拉和采用分压电路时的输出曲线示意图。

曲线①，使能上拉至输入，此时输出上升时间长且会受到输入波动的影响；

曲线②，合理采用分压电阻，当VIN上升到70%_{80%的时候，再使EN的电压到达使能阈值，此时输出上升边沿陡峭，输出平稳ÿ}