ICC2:clock tree分析实例

已于 2023-07-02 10:00:58 修改
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分类专栏： 数字后端设计（ICC2+INNOVUS+Starrc+PT） 文章标签： 后端 学习
于 2022-06-30 19:42:46 首次发布
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本文通过实例分析了分频器的时钟树平衡问题，主要讨论了如何处理分频器与后续寄存器之间的setup或hold违例。在ICC2工具中，通过设置平衡点和调整detour delay cell来优化时序。同时，提到了mem/CLK的源延迟设置对长树平衡的影响，并提供了抹平这种影响的方法。

摘要生成于 C知道 ，由 DeepSeek-R1 满血版支持， 前往体验 >

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1）分频器的timing check

长tree原则上只需要把同频时钟做平衡

如下示例，分频器所在的reg与其主时钟的sink之间的timing check，如图1。

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图1

div_1或div_2与FF3之间有timing check，理论上将除非前端设计故意刁难后端工程师否则不会出现div_1、div_2与FF1、FF2的timing check，很好理解，这样skew太大时序很难收敛，综合时考虑不到这种问题。所以常见的问题多是出在div_1/div_2与FF3之间的setup或hold违例。

解决办法:

1、CTS阶段，让分频器与FF3长tree做平，ICC2的命令如下:

set_clock_balance_points -c

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