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最近在调试ZYNQ-7010系列的版块时，PL与Linux系统通过AXI-BRAM进行32bit数据交互，发现经常出现bram内存未更新，
一直困扰了两天，一度找不到背锅侠，哈哈，最终原因还是在PL侧，解决思路如下：
1、降低AXI-BRAM 系统clk频率（暂认定为主要原因，具体仍需研究datasheet）
--->> CLK_100MHz降为CLK_50MHz
因为手册中提到，fmax=150MHz，不排除该芯片达不到其一般的水准（待确认）
2、尽量避免addr/data输入的右侧存在多级运算（代码风格问题，非主要因素，但仍需注意）
3、优化状态机逻辑，一个always中尽量至多3个寄存器并存（代码风格问题，非主要因素，但仍需注意）
4、补充说明：一定要注意PL和PS是否会同时对bram进行读写，如果不排除同时的可能性，强烈建议使用乒乓读写的设置！
ZYNQ linux AXI 读写,ZYNQ linux下AXI_BRAM的使用方法，PS与PL端数据交互
1、AXI总线、AXI接口、AXI协议总线是一组传输通道，是各种逻辑器件构成的传输数据的通道；接口是一种连接标准，又常被称为物理接口；协议是数据传输的规则。PS与PL连接方式主要是通过AXI总线进行的。ZYNQ上的总线协议有AXI4, AXI4-Lite, AXI4-Stream三种总线协议。而PS与PL之间的接口(AXI-GP、AXI-HP、AXI-ACP)只支持AXI4与AXI4-Lite这两...
zynq操作系统： Linux驱动开发Bram篇
前言 裸奔的驱动已经满足不了更高应用范围需求了，本篇开始更新几篇赶鸭子上架的zynq Linux应用层的驱动开发（基于准备篇）。再加上由于项目的时间紧张关系（重点是有些人不信邪不得不满足的需求），将基于裸板中关于DMA的数据搬移换成了简单的BRAM的形式，好处是可以短时间内做好驱动了，缺点是bram的速率相较于dma实在是太慢了，尤其受到axi总线限制，PL端实测最高速率3.9兆每秒左右，只能说是应个急，短期内可以满足下需求吧，毕竟，对于像我这样根本没有接触过linux的也能很快上手。重点有三个，代码也
【FPGA开发】ZYNQ中PS与PL高效数据交互：BRAM与DMA实战解析与性能对比
本文深入解析ZYNQ芯片中PS与PL的高效数据交互方案，重点对比BRAM与DMA两种方式的实战应用与性能差异。通过实测数据展示BRAM在低延迟小数据量传输的优势，以及DMA在高吞吐量大数据量场景的卓越表现，为FPGA开发者提供优化策略和常见问题解决方案。
【JokerのZYNQ7020】LINUX_BRAM。
zynq bram
Zynq Linux 环境下 AXI BRAM 控制器性能优化实战（UIO vs 自定义驱动）
本文通过一个真实的高速数据采集项目，深入对比了Zynq Linux环境下AXI BRAM控制器的两种驱动方法：UIO与自定义驱动。文章详细分析了UIO方案开发便捷但性能受限的局限性，并重点阐述了自定义驱动在延迟、吞吐量和CPU效率方面的显著优势，提供了具体的性能测试数据和代码示例，为开发者选择最优驱动方案提供了实践指导。
Zynq Linux下AXI BRAM三种驱动方法实战对比：从UIO到自定义驱动的性能实测
本文深入探讨了Zynq Linux下AXI BRAM的三种驱动方法，包括UIO、/dev/mem直接映射和自定义驱动，通过性能实测对比分析各自的优缺点。文章提供了详细的代码示例和优化技巧，帮助开发者在嵌入式系统开发中选择最适合的驱动方案，提升系统性能和稳定性。
Linux下pl与ps端的通信,zedboard通过BRAM实现PS和PL的简单通信
使用Block Memory进行PS和PL的数据交互或者数据共享，通过zynq PS端的Master GP0端口向BRAM写数据，然后再通过PS端的Mater GP1把数据读出来，将结果打印输出到串口终端显示。涉及到AXI BRAM Controller 和 Block Memery Generator等IP的使用。本文所使用的开发板是zedboardPC 开发环境版本：Vivado 2016.2...
ZYNQ petalinux系统使用axi_bram进行PL与PS数据交互
可以用BRAM，在PS和PL之间进行数据的交换。C, 最终sys_mmap调用底层驱动的mmap接口,并且内核将第2步创建这个对象的首地址传递给底层驱动的mmap接口,将来底层驱动的mmap接口可以通过这个对象的指针来获取到用户空闲虚拟内存的属性 (PROT_READ|PROT_WRITE,起始地址,大小,偏移量等等)本质：与其说是将一个文件映射到用户的虚拟地址上不如说是将这个文件对应的硬件的物理地址，映射用户的虚拟地址上,将来用户访问这个用户虚拟地址就是在访问对应的外设的物理地址。
ZYNQ Linux 开发：基于 devmem 的 BRAM 与 AXI GPIO 快捷测试脚本解析
本文介绍了一种基于devmem工具的ZYNQ Linux开发快速测试方法。通过Shell脚本直接读写物理内存地址，实现PS端与PL端的高效通信。脚本包含向BRAM写入12个32位配置数据，并通过AXI GPIO发送触发脉冲的功能。详细解析了地址映射、权限检测、数据填充和脉冲产生等关键环节，并提供了运行注意事项。该方法无需编写内核驱动或C程序，可快速验证PL端逻辑功能，是ZYNQ/FPGA开发的高效调试手段。
ZYNQ异构架构精髓：AXI_BRAM赋能PS-PL协同计算的终极指南
在嵌入式异构计算领域，Xilinx ZYNQ系列SoC以其独特的"ARM+FPGA"架构开创了处理器系统（PS）与可编程逻辑（PL）协同计算的新范式。作为连接两大计算域的核心枢纽，AXI_BRAM控制器在数据交互效率与资源利用率方面展现出惊人的设计智慧。本文将通过理论解析、实践指南与创新应用三个维度，深度解构AXI_BRAM在PS-PL异构通信中的核心价值，并分享突破传统性能边界的创新实践方案。
bram_driver_linux_
编写Linux对Bram的控制信息，满足Linux 对逻辑器件的读写要求。
Zynq 7000 PL和PS通信——使用BRAM
Zynq 7000 PL和PS通信——使用BRAM介绍1 准备工作2 PL搭建BRAM3 下载PL程序4 编写Linux应用程序5 问题5.1 BRAM的寻址的问题5.2 PS地址映射 介绍 Xilinx公司的Zynq 7000系列SoC除了有功能强大的FPGA，还集成了双PS。在协同使用PS和PL时，就不免需要PS和PL之间进行数据交互。本文主要讲述安装了linux操作系统的PS如何与PL进行数...
Python 格点数据插值到站点 最邻近插值 双线性插值
python 气象数据格点数据插值到站点，最邻近插值法，双线性插值法
ZYNQ linux下AXI_BRAM的使用方法，PS与PL端数据交互
而PS与PL之间的接口（AXI-GP、AXI-HP、AXI-ACP）只支持AXI4与AXI4-Lite这两种总线协议。也可以将BRAM与socket进行联合使用，将PC端的数据发到PS端，PS端放在PL端，PL端再发给PS端，PS端发回PC端。可以在address editor中查看自动分配的BRAM控制器的地址，不要随意更改地址，因为其他地址可能被其他设备占用了。协议是数据传输的规则。2、简单双端口：有两个端口连接到BRAM，一个端口只读，一个端口只写。1、AXI总线、AXI接口、AXI协议。
避坑指南：Win11修改用户文件夹名称后，如何彻底解决残留文件与路径错误？
本文针对Win11用户修改用户文件夹名称后遇到的残留文件与路径错误问题，提供了一套完整的解决方案。从诊断进程占用、使用资源监视器与命令行强力清理，到修复系统环境变量与软件配置，并详细介绍了创建符号链接这一终极兼容方案，帮助用户彻底解决路径依赖问题，恢复系统稳定。
Apache Hop集成Spring Boot实战：从配置到执行HPL文件
本文详细介绍了将Apache Hop集成到Spring Boot应用中的完整实战方案。通过配置核心依赖、初始化Hop环境、编写服务层逻辑，实现了在Java应用中程序化执行HPL管道文件，从而将可视化ETL能力无缝嵌入微服务架构，提升数据处理的自动化与可维护性。
【ZYNQ Linux开发】BRAM的几种驱动方式
对于ZYNQ而言，BRAM是PS与PL间通信的重要方式，属于中等数据量的通信，本文就运行Linux如何对其进行驱动进行了介绍。
材料带隙预测（图神经网络）（⭐⭐）—— 用晶体图网络预测钙钛矿材料的能带隙，加速光伏材料筛选。技术栈：CGCNN、MEGNet、Materials Project数据集
钙钛矿太阳能电池以其高效率、低成本的优势迅速崛起，但传统“试错法”材料筛选效率极低，严重制约了光伏技术的迭代速度。近年来，基于图神经网络的材料带隙预测方法，特别是晶体图神经网络（CGCNN）和材料图网络（MEGNet），为这一问题提供了革命性的解决方案。本文系统梳理了材料带隙预测从传统计算到深度学习的演进历程，深入剖析了CGCNN与MEGNet的架构设计、数学原理及创新机制，详细阐述了Materials Project数据集的构建、特征工程与处理策略。
手把手教你用Zynq AXI BRAM实现Linux与FPGA高速数据交换（附DMA优化技巧）
本文详细介绍了如何在Zynq平台上使用AXI BRAM实现Linux系统与FPGA之间的高速数据交换，包括AXI BRAM控制器架构解析、Linux驱动实现方案对比以及DMA加速技术实战。通过代码示例和性能实测数据，帮助开发者掌握千兆级数据传输通道的构建与优化技巧，适用于工业数据采集和实时控制系统。
《Linux GPU 驱动核心机制：面向图形与 AI 计算的 DRM 内存管理与任务调度》 目录
本文以缓冲区对象（BO）生命周期为主线，系统解析 Linux DRM 子系统中 GPU 驱动的核心机制。涵盖 GEM 与 TTM 内存管理、dma-buf/dma-fence 共享同步、GPU 调度与地址空间管理，结合 amdgpu、Xe 等驱动代码，深入剖析其设计动机与实现逻辑。旨在填补中文领域对 GPU 内核机制系统性讲解的空白，为图形与 AI 计算场景下的内存泄漏、同步死锁等疑难问题提供可追溯的分析路径。
AUTOSAR OS详细介绍及配置说明(更新版20240115)
AUTOSAR OS扩展了OSEK/VDX标准中的操作系统，所以本文结合OSEK/VDX的标准来介绍AUTOSAR OS，并借助Vector Configurator讲解AUTOSAR OS的配置。源于德语，英文意思是：“车载电子设备的开发系统和接口”，它是一个标准，用来产生嵌入式操作系统的规范，通讯协议栈，和汽车网络管理协议，也产生其他相关的规范。OSEK被设计来提供整车的各种电子控制单元的软件标准架构。
ZYNQ下Linux驱动代码的编写
好长时间没有更新博客了，因为最近比较烦躁所以没有心情去写了，今天这篇呢就写一下在ZYNQ上跑linux系统后的驱动代码编写。 用到ZYNQ芯片后那么必然会涉及到PS和PL之间的通信（本文主要说的是ZYNQ跑的linux系统。裸机不在本文范围内（一直觉得xilinx的SDK做的比较烂，不想用）），PL和PS之间的通信总线是基于AXI总线（关于这个总线自己去查，他有好几种方式，我不管了），一般情况下PL较大的数据传递到PS时用DMA是比较方便的（也需要写驱动），但是也有另外一种方式通过PL内的BRAM来实现。
STM32 TIM3硬件XOR+复位模式实现霍尔信号精准捕获
霍尔传感器是电机控制系统中获取转子位置的关键器件，其三路数字信号需通过高精度、低延迟的边沿检测机制转换为电角度信息。其核心原理在于利用定时器输入XOR逻辑合并多路信号，并结合从模式复位（Reset Mode）实现硬件级时间间隔测量——每次跳变强制计数器清零，使CNT值直接表征换相周期。该方案规避了软件轮询的不确定性，显著提升FOC控制的实时性与鲁棒性。典型应用场景包括BLDC/FOC电机驱动、机器人关节伺服及工业变频器设计，尤其适用于STM32F4系列等具备硬件XOR与从模式控制器的MCU平台。
ZYNQ AXI_DMA_UDP以太网传输（三）
本次实验跟之前的实验有所不同，不同点在于：1、前面一个实验的UDP协议，ZYNQ板卡是作为服务端（Server），向PC端一直主动的发数据，但是这一次不同，这一次ZYNQ板卡是作为客户端（Client），需要等待PC端发送相应指令，然后进入UDP协议接收回调函数，再往PC端发送一次数据；2、另一个不同点在于，本次实验加入了将PC端的参数文件通过UDP协议发送到PS端，然后PS端通过AXI BRAM CTRL下发到PL端的BRAM中。
文档：亲测可用解决vnc灰屏，黑屏，鼠标大黑叉情况
主要解决vnc-viewer灰屏，黑屏，鼠标大黑叉等现象，详细见文档。
ssm框架搭建
这个是一个在idea上成功跑起来的ssm框架项目，保存在这里方便以后使用直接下载
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