一分钟演示32位五级流水线MIPS-CPU设计

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一分钟演示32位五级流水线MIPS-CPU设计,向计算机先驱致敬


BGM：Running-Alexandre Desplat 来自《模仿游戏》原声
此设计为NUAA-CCST-2020计算机组成原理课程设计题目：36/45指令 32位 MIPS CPU数据通路设计。

借此视频向计算机先驱们致敬。

标签
#cpu #mips
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计算机组成原理32位MIPS CPU设计实验（指令译码器电路设计 、时序发生器状态机设计、时序发生器输出函数、硬布线控制器） 实验四 32位MIPS CPU设计实验 这次实验是32位MIPS CPU设计实验（单总线CPU-定长指令周期-3级时序)，在头歌当中一共需要我们进行六道题的测试，分别为MIPS指令译码器设计，定长指令周期（时序发生FSM设计，时序发生器输出函数设计，硬布线控制器，单总线CPU设计），硬布线控制器组合逻辑单元。其中由于第六题是对前面五题一个最终的检验，所以我们不需要进行新的设计，这边我按照老师给的提纲分享了以下四个实验的具体设计原理：1、指令译码器电路设计 2、时序发生器状态机（定长指令周期）设计3、时序发生 阅读详情

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