数字 IC 技能拓展（28）浅谈低功耗设计技术

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文章标签： FPGA IC 低功耗 Verilog 集成电路
于 2021-10-03 12:14:57 首次发布
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本文链接：https://blog.youkuaiyun.com/MicroTalent12/article/details/107080312
本文探讨了数字IC设计中的低功耗技术，包括流水并行、资源共享、状态编码、门控时钟、操作数隔离、门级电路优化、多阈值电压等方法，旨在降低静态和动态功耗，实现高效节能的集成电路设计。

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引言

        作为 PPA 的成员之一，低功耗技术显得尤为重要，是未来 IC 设计的一个方向。本文主要介绍一些常用的低功耗设计技术如流水并行、资源共享、状态编码、门控时钟、操作数隔离、门级电路功耗优化、多阈值电压。

正文

        功耗分为静态功耗和动态功耗，动态功耗又分为短路功耗（内部功耗）和开关功耗（翻转功耗）。

        静态功耗：在数字 CMOS 电路中，漏电流引起的功耗。

        由于静态功耗一般与工艺器件有关，不加以讨论，我们重点关注动态功耗。

        短路功耗：

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